用64K×1位的DRAM芯片構(gòu)成256K×8位的存儲器。要求:
(1)計算所需芯片數(shù),并畫出該存儲器的邏輯框圖。
(2)若采用異步刷新方式,每單元刷新間隔不超過2ms,則產(chǎn)生刷新信號的間隔是多少時間?若采用集中刷新方式,則存儲器刷新一遍最少用多少讀寫周期?
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在編號分別為0,1,2,……,9的16個處理器之間,要求按下列配對通信:(B、1),(8、2),(7、D),(6、C),(E、4),(A、0),(9、3),(5、F)。試選擇所用互連網(wǎng)絡(luò)類型、控制方式,并畫出該互連網(wǎng)絡(luò)的拓?fù)浣Y(jié)構(gòu)和各級的交換開關(guān)狀態(tài)圖。
為了使存儲系統(tǒng)的訪問效率達(dá)到0.94,命中率和等效訪問周期應(yīng)該提高到多少?
如果一條指令的執(zhí)行過程分解為“取指令”和“分析”兩個階段,并采用兩級流水線。為了采用指令取消技術(shù),請修改上面的程序。
若采用FIFO替換算法,計算Cache的塊命中率。
指出主存與Cache之間各個塊的映象關(guān)系。
畫出其中一組的邏輯圖。
為了使存儲系統(tǒng)的訪問效率從0.5提高到0.94,塊的大小至少增加到幾個字?
一臺機(jī)器要求浮點數(shù)的字長的精度不低于10-7.2,表數(shù)的范圍正數(shù)不小于1038,且正負(fù)對稱。尾數(shù)用原碼、純小數(shù)表示,階碼用移碼、整數(shù)表示。設(shè)計這種浮點數(shù)的格式。
如果把一條指令的執(zhí)行過程分解為“取指令”、“分析”(包括譯碼和取操作數(shù)等)和“執(zhí)行”(包括運(yùn)算和寫回結(jié)果等)三個階段,并采用三級流水線。仍然要采用指令取消技術(shù),請修改上面的程序。
共需要多少個觸發(fā)器和多少個與門?