假定一個(gè)計(jì)算機(jī)系統(tǒng)中有一個(gè)TLB和一個(gè)L1 data cache。該系統(tǒng)按字節(jié)編址,虛擬地址16位,物理地址12位;頁大小為128B,TLB為四路組相聯(lián),共有16個(gè)頁表項(xiàng);L1 data cache采用直接映射方式,塊大小為4B,共16行。在系統(tǒng)運(yùn)行到某一時(shí)刻時(shí),TLB、頁表和L1 data cache中的部分內(nèi)容(用十六進(jìn)制表示)如下:
虛擬地址中哪幾位表示虛擬頁號(hào)?哪幾位表示頁內(nèi)偏移量?虛擬頁號(hào)中哪幾位表示TLB標(biāo)記?哪幾位表示TLB索引?
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如果N=100,采用指令取消技術(shù)后,在程序執(zhí)行過程中,能夠節(jié)省多少個(gè)指令周期?
若對(duì)數(shù)字0~9和空格采用二進(jìn)制編碼,試設(shè)計(jì)編碼平均長(zhǎng)度最短的編碼。
如果把一條指令的執(zhí)行過程分解為“取指令”、“分析”(包括譯碼和取操作數(shù)等)和“執(zhí)行”(包括運(yùn)算和寫回結(jié)果等)三個(gè)階段,并采用三級(jí)流水線。仍然要采用指令取消技術(shù),請(qǐng)修改上面的程序。
寫出主存地址和Cache地址的格式,并標(biāo)出各字段的長(zhǎng)度。
畫出流水線任務(wù)調(diào)度的狀態(tài)有向圖。
如果一條指令的執(zhí)行過程分解為“取指令”和“分析”兩個(gè)階段,并采用兩級(jí)流水線。為了采用指令取消技術(shù),請(qǐng)修改上面的程序。
有一個(gè)16KB4路組相聯(lián)Cache的32位微處理器,假定該Cache的塊為4個(gè)32位的字。主存地址為ABCDE8F8的單元在Cache中的什么位置。
寫出N=8的蝶式置換的互連函數(shù),如采用Omega網(wǎng)絡(luò),則需幾次通過才能完成此變換?畫出Omega網(wǎng)絡(luò)實(shí)現(xiàn)此變換的控制狀態(tài)圖。
考慮題目全部要求,設(shè)計(jì)優(yōu)化實(shí)用的操作碼形式,并計(jì)算其操作碼的平均碼長(zhǎng)。
指出主存與Cache之間各個(gè)塊的映象關(guān)系。