A.擴(kuò)大存儲系統(tǒng)的容量
B.提高存儲系統(tǒng)的速度
C.擴(kuò)大存儲系統(tǒng)的容量和提高存儲系統(tǒng)的速度
D.便于程序的訪存操作
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A．主存地址
B．邏輯地址
C．物理地址
D．有效地址
A.定長編碼
B.哈夫曼編碼
C.擴(kuò)展編碼
D.需要根據(jù)編碼使用的頻度計(jì)算平均碼長后確定
A.縮短指令字長
B.減少程序總位數(shù)
C.增加指令字表示的信息
D.A和B和C
A.訪存速度快
B.節(jié)約主存單元
C.指令字的規(guī)整化
D.指令的優(yōu)化
A.CPU中的通用寄存器
B.主存儲器
C.I/O接口中的寄存器
D.堆棧
最新試題
要求操作碼的平均長度最短，請?jiān)O(shè)計(jì)操作碼的編碼，并計(jì)算操作碼編碼的平均長度。
浮點(diǎn)數(shù)系統(tǒng)使用的階碼基值re=2，階值位數(shù)q=2，尾數(shù)基值rm=10，尾數(shù)位數(shù)p′=1，即按照使用的二進(jìn)制位數(shù)來說，等價(jià)于p=4。計(jì)算在非負(fù)階、正尾數(shù)、規(guī)格化情況下的最小尾數(shù)值、最大尾數(shù)值、最大階值、可表示的最小值和最大值及可表示數(shù)的個(gè)數(shù)。
指出主存與Cache之間各個(gè)塊的映象關(guān)系。
為了使存儲系統(tǒng)的訪問效率從0.5提高到0.94，塊的大小至少增加到幾個(gè)字？
若Cache的4個(gè)塊號為C0、C1、C2和C3，列出程序執(zhí)行過程中的Cache塊地址流。
畫出其中一組的邏輯圖。
可能的最高頁命中率是多少？
若采用LRU替換算法，計(jì)算Cache的塊命中率。
假設(shè)在3000次訪存中，第一級Cache不命中110次，第二級Cache不命中55次。試問：在這種情況下，該Cache系統(tǒng)的局部不命中率和全局不命中率各是多少？
設(shè)計(jì)8位字長的寄存器—寄存器型指令3條，16位字長的寄存器一存儲器型變址尋址方式指令4條，變址范圍不小于正、負(fù)127。請?jiān)O(shè)計(jì)指令格式，并給出指令各字段的長度和操作碼的編碼。