A.314
B.630
C.1414
D.3030
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A.地址總線寬度
B.數(shù)據(jù)總線寬度
C.主存儲(chǔ)器的容量
D.CPU的字長
A.Cache擴(kuò)充了主存儲(chǔ)器的容量
B.Cache可以降低由于CPU與主存之間的速度差異造成的系統(tǒng)性能影響
C.Cache的有效性是利用了對(duì)主存儲(chǔ)器訪問的局部特征
D.Cache中通常保存著主存儲(chǔ)器中部分內(nèi)容的一份副本
A.系統(tǒng)總線的寬度為32位
B.處理的數(shù)據(jù)長度只能為32位
C.CPU字長為32位
D.通用寄存器數(shù)目為32個(gè)
A.4
B.6
C.8
D.10
A."1"的個(gè)數(shù)為奇數(shù)
B."1"的個(gè)數(shù)為偶數(shù)
C.最低位為"1"
D.最高位為"1"
A.DRAM
B.EPROM
C.SRAM
D.EEPROM
A.時(shí)鐘周期大于機(jī)器周期
B.指令周期等于機(jī)器周期
C.機(jī)器周期大于指令周期
D.指令周期大于時(shí)鐘周期
A.7FFF
B.8FFF
C.9FFF
D.AFFF
A.算術(shù)邏輯運(yùn)算單元
B.控制器
C.通用寄存器組
D.I/O總線
最新試題
將某ASCII字符采用偶校驗(yàn)編碼（7位字符編碼+1位校驗(yàn)碼）發(fā)送給接收方，在接收方收到的8位數(shù)據(jù)中，若（），則能確定傳輸過程中發(fā)生的錯(cuò)誤。
計(jì)算機(jī)中，執(zhí)行一條指令所需要的時(shí)間稱為指令周期，完成一項(xiàng)基本操作所需要的時(shí)間稱為機(jī)器周期，時(shí)鐘脈沖的重復(fù)周期稱為時(shí)鐘周期。因此（）。
設(shè)兩個(gè)8位補(bǔ)碼表示的數(shù)和相加時(shí)溢出（b7、a7為符號(hào)標(biāo)志），則（）。
以下關(guān)于CPU與主存之間增加調(diào)整緩存（Cache）的敘述，不正確的是（）。
十六進(jìn)制數(shù)CC所對(duì)應(yīng)的八進(jìn)制數(shù)為（）。
邏輯變量X、Y，進(jìn)行邏輯"異或"（用""表示）運(yùn)算的含義是：若X、Y取值相同（都為true或都為false），則的值為false，否則的值為true，用邏輯"與"（∧）、"或"（∨）、"非"（-）表示的式子為（）。
中央處理單元（CPU）不包括（）。
若用8位機(jī)器碼表示二進(jìn)制數(shù)-111，則原碼表示的十六進(jìn)制形式為（1）；補(bǔ)碼表示的十六進(jìn)制形式（2）?？瞻祝?）處應(yīng)選擇（）
（）不是使用光（激光）技術(shù)來存取數(shù)據(jù)的存儲(chǔ)介質(zhì)。
若指令系統(tǒng)中設(shè)置了專用I/O操作指令，則I/O接口（）。