單項選擇題在輸入量不變的情況下,若引入反饋后(),則說明引入的是負(fù)反饋。

A.輸入電阻增大
B.輸出量增大
C.凈輸入量增大
D.凈輸入量減小


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?verilogHDL中已經(jīng)預(yù)先定義了的門級原型的符號有()。

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在下圖中如果輸入輸出均有電容耦合,則將RG的阻值由10MΩ替換為1MΩ時,柵極直流電壓將會(),漏極直流電流將會(),輸入電阻將會()。

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題型:單項選擇題