單項(xiàng)選擇題在下述指令中,()指令包含的周期數(shù)最多。

A.RR型
B.RS型
C.SS型
D.零地址指令


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1.單項(xiàng)選擇題下述I/O控制方式中,()主要由程序?qū)崿F(xiàn)。

A.PPU(外圍處理機(jī))
B.中斷方式
C.DMA方式
D.通道方式

3.單項(xiàng)選擇題一臺(tái)計(jì)算機(jī)對(duì)n個(gè)數(shù)據(jù)源進(jìn)行分時(shí)采集,送入主存,然后分時(shí)處理。采集數(shù)據(jù)時(shí)最好方案是使用()。

A.堆棧緩沖區(qū)
B.一個(gè)指針的緩沖區(qū)
C.兩個(gè)指針的單緩沖區(qū)
D.n個(gè)指針的n個(gè)緩沖區(qū)

4.單項(xiàng)選擇題中央處理器(CPU)是包含()。

A.運(yùn)算器
B.控制器
C.運(yùn)算器.控制器和cache
D.運(yùn)算器、控制器和主存儲(chǔ)器

5.單項(xiàng)選擇題閃速存儲(chǔ)器稱為()。

A.光盤
B.固態(tài)盤
C.硬盤
D.軟盤

最新試題

如果N=100,采用指令取消技術(shù)后,在程序執(zhí)行過程中,能夠節(jié)省多少個(gè)指令周期?

題型:?jiǎn)柎痤}

為了使存儲(chǔ)系統(tǒng)的訪問效率從0.5提高到0.94,塊的大小至少增加到幾個(gè)字?

題型:?jiǎn)柎痤}

若Cache的4個(gè)塊號(hào)為C0、C1、C2和C3,列出程序執(zhí)行過程中的Cache塊地址流。

題型:?jiǎn)柎痤}

在編號(hào)分別為0,1,2,……,9的16個(gè)處理器之間,要求按下列配對(duì)通信:(B、1),(8、2),(7、D),(6、C),(E、4),(A、0),(9、3),(5、F)。試選擇所用互連網(wǎng)絡(luò)類型、控制方式,并畫出該互連網(wǎng)絡(luò)的拓?fù)浣Y(jié)構(gòu)和各級(jí)的交換開關(guān)狀態(tài)圖。

題型:?jiǎn)柎痤}

共需要多少個(gè)觸發(fā)器和多少個(gè)與門?

題型:?jiǎn)柎痤}

若對(duì)數(shù)字0~9和空格采用二進(jìn)制編碼,試設(shè)計(jì)編碼平均長(zhǎng)度最短的編碼。

題型:?jiǎn)柎痤}

假設(shè)在3000次訪存中,第一級(jí)Cache不命中110次,第二級(jí)Cache不命中55次。試問:在這種情況下,該Cache系統(tǒng)的局部不命中率和全局不命中率各是多少?

題型:?jiǎn)柎痤}

當(dāng)存儲(chǔ)系統(tǒng)的訪問效率為0.5時(shí),計(jì)算命中率和等效訪問周期。

題型:?jiǎn)柎痤}

浮點(diǎn)數(shù)系統(tǒng)使用的階碼基值re=2,階值位數(shù)q=2,尾數(shù)基值rm=10,尾數(shù)位數(shù)p′=1,即按照使用的二進(jìn)制位數(shù)來說,等價(jià)于p=4。計(jì)算在非負(fù)階、正尾數(shù)、規(guī)格化情況下的最小尾數(shù)值、最大尾數(shù)值、最大階值、可表示的最小值和最大值及可表示數(shù)的個(gè)數(shù)。

題型:?jiǎn)柎痤}

設(shè)計(jì)8位字長(zhǎng)的寄存器—寄存器型指令3條,16位字長(zhǎng)的寄存器一存儲(chǔ)器型變址尋址方式指令4條,變址范圍不小于正、負(fù)127。請(qǐng)?jiān)O(shè)計(jì)指令格式,并給出指令各字段的長(zhǎng)度和操作碼的編碼。

題型:?jiǎn)柎痤}