單項(xiàng)選擇題模4交叉存儲(chǔ)器有4個(gè)存儲(chǔ)模塊,它們有各自的()。

A.地址寄存器
B.地址寄存器和指令寄存器
C.地址寄存器和數(shù)據(jù)緩沖寄存器
D.地址寄存器、數(shù)據(jù)緩沖寄存器和指令寄存器


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1.單項(xiàng)選擇題浮點(diǎn)運(yùn)算器的描述中,正確的句子是()。

A.階碼部件可實(shí)現(xiàn)加、減、乘、除四種運(yùn)算
B.階碼部件只進(jìn)行階碼相加、相減和比較操作
C.階碼部件只進(jìn)行階碼相加、相減操作
D.尾數(shù)部件只進(jìn)行乘法和除法運(yùn)算

2.單項(xiàng)選擇題多路開(kāi)關(guān)是一種用來(lái)從n個(gè)數(shù)據(jù)源中選擇()數(shù)據(jù)送到一公共目的地的器件,其功能實(shí)現(xiàn)還可用()來(lái)代替。

A.一個(gè)以上,與非門(mén)
B.一個(gè),三態(tài)緩沖器
C.n個(gè),三態(tài)緩沖器
D.n個(gè)以上,或非門(mén)

3.單項(xiàng)選擇題目前大多數(shù)集成電路生產(chǎn)中,所采用的基本材料為()。

A.非晶硅
B.單晶硅
C.多晶硅
D.硫化鎘

最新試題

如果把一條指令的執(zhí)行過(guò)程分解為“取指令”、“分析”(包括譯碼和取操作數(shù)等)和“執(zhí)行”(包括運(yùn)算和寫(xiě)回結(jié)果等)三個(gè)階段,并采用三級(jí)流水線。仍然要采用指令取消技術(shù),請(qǐng)修改上面的程序。

題型:?jiǎn)柎痤}

浮點(diǎn)數(shù)系統(tǒng)使用的階碼基值re=2,階值位數(shù)q=2,尾數(shù)基值rm=10,尾數(shù)位數(shù)p′=1,即按照使用的二進(jìn)制位數(shù)來(lái)說(shuō),等價(jià)于p=4。計(jì)算在非負(fù)階、正尾數(shù)、規(guī)格化情況下的最小尾數(shù)值、最大尾數(shù)值、最大階值、可表示的最小值和最大值及可表示數(shù)的個(gè)數(shù)。

題型:?jiǎn)柎痤}

當(dāng)存儲(chǔ)系統(tǒng)的訪問(wèn)效率為0.5時(shí),計(jì)算命中率和等效訪問(wèn)周期。

題型:?jiǎn)柎痤}

寫(xiě)出主存地址和Cache地址的格式,并標(biāo)出各字段的長(zhǎng)度。

題型:?jiǎn)柎痤}

在編號(hào)分別為0,1,2,……,9的16個(gè)處理器之間,要求按下列配對(duì)通信:(B、1),(8、2),(7、D),(6、C),(E、4),(A、0),(9、3),(5、F)。試選擇所用互連網(wǎng)絡(luò)類型、控制方式,并畫(huà)出該互連網(wǎng)絡(luò)的拓?fù)浣Y(jié)構(gòu)和各級(jí)的交換開(kāi)關(guān)狀態(tài)圖。

題型:?jiǎn)柎痤}

一臺(tái)機(jī)器要求浮點(diǎn)數(shù)的字長(zhǎng)的精度不低于10-7.2,表數(shù)的范圍正數(shù)不小于1038,且正負(fù)對(duì)稱。尾數(shù)用原碼、純小數(shù)表示,階碼用移碼、整數(shù)表示。設(shè)計(jì)這種浮點(diǎn)數(shù)的格式。

題型:?jiǎn)柎痤}

若采用LRU替換算法,計(jì)算Cache的塊命中率。

題型:?jiǎn)柎痤}

如果在程序執(zhí)行過(guò)程中訪問(wèn)一個(gè)頁(yè)面,平均要對(duì)該頁(yè)面內(nèi)的存儲(chǔ)單元訪問(wèn)1024次,求訪問(wèn)存儲(chǔ)單元的命中率。

題型:?jiǎn)柎痤}

設(shè)16個(gè)處理器編號(hào)分別為0,1,…,15,要用單級(jí)互連網(wǎng)絡(luò),當(dāng)互連函數(shù)分別為:(1)Cube3(Cube1)(5)Butterfly(Butterfly)(8)σ-1(9)β(1)(13)ρ(2)時(shí),第13號(hào)處理器分別與哪一個(gè)處理器相連?

題型:?jiǎn)柎痤}

若在程序執(zhí)行過(guò)程中,每從主存裝入一塊到Cache,平均要對(duì)這個(gè)塊訪問(wèn)16次,計(jì)算在這種情況下的Cache命中率。

題型:?jiǎn)柎痤}