A.主存容量不足
B.主存與輔存速度不匹配
C.輔存與CPU速度不匹配
D.主存與CPU速度不匹配
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A.1.11000
B.0.01110
C.1.00010
D.0.01010
A.行波進(jìn)位
B.組內(nèi)先行進(jìn)位,組間先行進(jìn)位
C.組內(nèi)先行進(jìn)位,組間行波進(jìn)位
D.組內(nèi)行波進(jìn)位,組間先行進(jìn)位
A.0-4M
B.0-8MB
C.0-2M
D.0-4MB
A.X1=0,X2~X4至少有一個(gè)為1
B.X1=0,X2~X4任意
C.X1=1,X2~X4至少有一個(gè)為1
D.X1=1,X2~X4
A.增加處理機(jī)的開銷
B.增加控制線數(shù)
C.增加處理機(jī)的開銷和增加控制線數(shù)
D.以上都不對(duì)
最新試題
硬件堆棧是由CPU內(nèi)部的一組串聯(lián)的()組成的。
刷新控制電路的主要任務(wù)是解決刷新和()之間的矛盾。
RAM記憶單元從6管變到4管,在保持狀態(tài)時(shí)沒有外加電源供電,使得RAM成為了()。
軟件堆棧在工作中()移動(dòng)。
從給定的選項(xiàng)中選擇認(rèn)為正確的一項(xiàng)。A.并行B.串行C.端口D.接口E.輸出指令F.輸入指令(1)近距離設(shè)備與主機(jī)間傳輸數(shù)據(jù),適合選用()接口。(2)遠(yuǎn)程終端及計(jì)算機(jī)網(wǎng)絡(luò)設(shè)備等遠(yuǎn)離主機(jī)的設(shè)備傳輸信息,更適合選用()接口。(3)接口與端口是兩個(gè)不同的概念,()是指接口電路中可以被CPU直接訪問的寄存器。(4)CPU通過()可以從有關(guān)端口讀取信息。(5)CPU也可以通過()把信息寫入有關(guān)端口。
從給定的選項(xiàng)中選擇認(rèn)為正確的一項(xiàng)。A.存儲(chǔ)矩陣B.全相聯(lián)映像C.組相聯(lián)映像D.虛擬存儲(chǔ)器E.高速緩存F.主存地址空間G.輔存地址空間H.局部性I.局限性(1)無論是動(dòng)態(tài)存儲(chǔ)器還是靜態(tài)存儲(chǔ)器,都是由()、地址譯碼器和輸入、輸出控制電路組成的。(2)在Cache的三種映像方式中,()實(shí)際上是對(duì)另外兩種映像方式的折中,是它們的普遍形式。(3)計(jì)算機(jī)存儲(chǔ)系統(tǒng)中,()是解決運(yùn)行大程序主存空間不足所使用的技術(shù)。(4)虛擬存儲(chǔ)器有三種地址空間,其中()用于存放運(yùn)行的程序和數(shù)據(jù)。(5)多級(jí)結(jié)構(gòu)存儲(chǔ)器系統(tǒng),是建立在程序運(yùn)行的()原理之上的。
()是指參與運(yùn)算的數(shù)的基本位數(shù),是由加法器、寄存器的位數(shù)決定的。
已知X=10111001,Y=-00101011,求[X +Y]補(bǔ),正確結(jié)果為()。
存儲(chǔ)器堆棧需要設(shè)置一個(gè)專門的硬件寄存器,稱為(),而寄存器堆棧則沒有。
計(jì)算機(jī)采用總線結(jié)構(gòu)的好處是()。