A.增加cache中的塊數(shù)
B.增大組的大小
C.增大主存容量
D.增大塊的大小
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A.同一條指令的讀操作與寫操作之間的寫后讀沖突。
B.先流入的指令的寫操作與后流入的指令的讀操作之間的寫后讀沖突
C.后流入的指令的寫操作與先流入的指令的讀操作之間的讀后寫沖突
D.兩條指令的寫操作之間的寫后寫沖突
A.目錄表小
B.塊沖突概率低
C.命中率高
D.主存利用率高
A.擴大存儲系統(tǒng)的容量
B.提高存儲系統(tǒng)的速度
C.擴大存儲系統(tǒng)的容量和提高存儲系統(tǒng)的速度
D.便于程序的訪存操作
A.主存地址
B.邏輯地址
C.物理地址
D.有效地址
A.定長編碼
B.哈夫曼編碼
C.擴展編碼
D.需要根據(jù)編碼使用的頻度計算平均碼長后確定
最新試題
若Cache的4個塊號為C0、C1、C2和C3,列出程序執(zhí)行過程中的Cache塊地址流。
如果在程序執(zhí)行過程中訪問一個頁面,平均要對該頁面內的存儲單元訪問1024次,求訪問存儲單元的命中率。
畫出其中一組的邏輯圖。
如果一條指令的執(zhí)行過程分解為“取指令”和“分析”兩個階段,并采用兩級流水線。為了采用指令取消技術,請修改上面的程序。
設16個處理器編號分別為0,1,…,15,要用單級互連網(wǎng)絡,當互連函數(shù)分別為:(1)Cube3(Cube1)(5)Butterfly(Butterfly)(8)σ-1(9)β(1)(13)ρ(2)時,第13號處理器分別與哪一個處理器相連?
指出主存與Cache之間各個塊的映象關系。
要求操作碼的平均長度最短,請設計操作碼的編碼,并計算操作碼編碼的平均長度。
浮點數(shù)系統(tǒng)使用的階碼基值re=2,階值位數(shù)q=2,尾數(shù)基值rm=10,尾數(shù)位數(shù)p′=1,即按照使用的二進制位數(shù)來說,等價于p=4。計算在非負階、正尾數(shù)、規(guī)格化情況下的最小尾數(shù)值、最大尾數(shù)值、最大階值、可表示的最小值和最大值及可表示數(shù)的個數(shù)。
至少要分配給該程序多少個主存頁面才能獲得最高的命中率?
考慮題目全部要求,設計優(yōu)化實用的操作碼形式,并計算其操作碼的平均碼長。