單項(xiàng)選擇題時(shí)序邏輯電路的輸出端取數(shù)如有問題會產(chǎn)生()。

A、時(shí)鐘脈沖混亂
B、置數(shù)端無效
C、清零端無效
D、計(jì)數(shù)模錯(cuò)誤


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2.單項(xiàng)選擇題集成譯碼器的()狀態(tài)不對時(shí),譯碼器無法工作。

A、輸入端
B、輸出端
C、清零端
D、使能端

3.單項(xiàng)選擇題集成計(jì)數(shù)器74LS192是()計(jì)數(shù)器。

A、異步十進(jìn)制加法
B、同步十進(jìn)制加法
C、異步十進(jìn)制減法
D、同步十進(jìn)制可逆

4.單項(xiàng)選擇題集成譯碼器74LS138的3個(gè)使能端,只要有一個(gè)不滿足要求,其八個(gè)輸出為()。

A、高電平
B、低電平
C、高阻
D、低阻

5.單項(xiàng)選擇題當(dāng)74LS94的控制信號為01時(shí),該集成移位寄存器處于()狀態(tài)。

A、左移
B、右移
C、保持
D、并行置數(shù)

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