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A.地址寄存器
B.地址寄存器和指令寄存器
C.地址寄存器和數(shù)據(jù)緩沖寄存器
D.地址寄存器、數(shù)據(jù)緩沖寄存器和指令寄存器
A.階碼部件可實(shí)現(xiàn)加、減、乘、除四種運(yùn)算
B.階碼部件只進(jìn)行階碼相加、相減和比較操作
C.階碼部件只進(jìn)行階碼相加、相減操作
D.尾數(shù)部件只進(jìn)行乘法和除法運(yùn)算
A.一個(gè)以上,與非門(mén)
B.一個(gè),三態(tài)緩沖器
C.n個(gè),三態(tài)緩沖器
D.n個(gè)以上,或非門(mén)
A.非晶硅
B.單晶硅
C.多晶硅
D.硫化鎘
最新試題
為了使存儲(chǔ)系統(tǒng)的訪問(wèn)效率達(dá)到0.94,命中率和等效訪問(wèn)周期應(yīng)該提高到多少?
如果把一條指令的執(zhí)行過(guò)程分解為“取指令”、“分析”(包括譯碼和取操作數(shù)等)和“執(zhí)行”(包括運(yùn)算和寫(xiě)回結(jié)果等)三個(gè)階段,并采用三級(jí)流水線(xiàn)。仍然要采用指令取消技術(shù),請(qǐng)修改上面的程序。
如果一條指令的執(zhí)行過(guò)程分解為“取指令”和“分析”兩個(gè)階段,并采用兩級(jí)流水線(xiàn)。為了采用指令取消技術(shù),請(qǐng)修改上面的程序。
若對(duì)數(shù)字0~9和空格采用二進(jìn)制編碼,試設(shè)計(jì)編碼平均長(zhǎng)度最短的編碼。
僅根據(jù)使用頻度,不考慮其它要求,設(shè)計(jì)出全Huffman操作碼,計(jì)算其平均碼長(zhǎng)。
在有16個(gè)處理器的均勻洗牌網(wǎng)絡(luò)中,若要使第0號(hào)處理器與第15號(hào)處理器相連,需要經(jīng)過(guò)多少次均勻洗牌和交換置換。
浮點(diǎn)數(shù)系統(tǒng)使用的階碼基值re=2,階值位數(shù)q=2,尾數(shù)基值rm=10,尾數(shù)位數(shù)p′=1,即按照使用的二進(jìn)制位數(shù)來(lái)說(shuō),等價(jià)于p=4。計(jì)算在非負(fù)階、正尾數(shù)、規(guī)格化情況下的最小尾數(shù)值、最大尾數(shù)值、最大階值、可表示的最小值和最大值及可表示數(shù)的個(gè)數(shù)。
有一個(gè)16KB4路組相聯(lián)Cache的32位微處理器,假定該Cache的塊為4個(gè)32位的字。主存地址為ABCDE8F8的單元在Cache中的什么位置。
若采用LRU替換算法,計(jì)算Cache的塊命中率。
寫(xiě)出流水線(xiàn)的初始沖突向量。