A.二進(jìn)制
B.八進(jìn)制
C.十進(jìn)制
D.十六進(jìn)制
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你可能感興趣的試題
A.VHDL程序中是區(qū)分大小寫的。
B.一個(gè)完整的VHDL程序總是由庫說明部分、實(shí)體和結(jié)構(gòu)體等三部分構(gòu)成
C.VHDL程序中的實(shí)體部分是對元件和外部電路之間的接口進(jìn)行的描述，可以看成是定義元件的引腳
D.結(jié)構(gòu)體是描述元件內(nèi)部的結(jié)構(gòu)和邏輯功能
A.S＝R＝0
B.S＝R＝1
C.S＝1，R＝0
D.S＝0，R＝1
A.11110001
B.11101111
C.01101111
D.00010001
某觸發(fā)器的狀態(tài)轉(zhuǎn)換圖如圖所示，該觸發(fā)器應(yīng)是（）
A.J-K觸發(fā)器
B.R-S觸發(fā)器
C.D觸發(fā)器
D.T觸發(fā)器
分析圖中所示輸入、輸出Q的波形。則該觸發(fā)器為（）
A.上升沿觸發(fā)的JK觸發(fā)器
B.上升沿觸發(fā)的SR觸發(fā)器
C.下降沿觸發(fā)的JK觸發(fā)器
D.下降沿觸發(fā)的SR觸發(fā)器
最新試題
要實(shí)現(xiàn)3變量的邏輯函數(shù)，可以使用（）加上若干基本邏輯門來實(shí)現(xiàn)。
兩個(gè)狀態(tài)互為等價(jià)狀態(tài)，則它們一定（）。
D點(diǎn)有幾條支路？（）
若采用反饋異步清零法構(gòu)建9進(jìn)制的計(jì)數(shù)器，則反饋信號應(yīng)該根據(jù)（）狀態(tài)來生成。
555芯片的4腳可以直接控制輸出端3腳的電位，2腳也可以控制輸出端3腳的電位，6腳也可以控制輸出端3腳的電位，那么這三個(gè)引腳哪個(gè)的優(yōu)先級別最高？（）
雙向移位寄存器的數(shù)據(jù)輸入方式不包括（）。
下圖是一張（）觸發(fā)器的狀態(tài)圖。
在這個(gè)電路中，所有的半導(dǎo)體器件均處于開關(guān)狀態(tài)。問二極管的狀態(tài)有可能是哪些狀態(tài)？（）?
模擬量是（）的，數(shù)字量是（）的。
某觸發(fā)器的特性方程為Qn+1=，這是一個(gè)（）觸發(fā)器。