A.R=0，S=0
B.R=0，S=1
C.R=1，S=0
D.R=1，S=1
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已知某電路的真值表如下，該電路的邏輯表達(dá)式為（）。
A.Y=C
B.Y=ABC
C.Y=AB+C
D.Y=BC+C
A.CMOS
B.TTL
C.主從或維持阻塞
D.沒(méi)有記憶功能
E.邊沿JK或邊沿
F.觸發(fā)器
G.同步RS觸發(fā)器
A.都接高電平“1”
B.都接低電平“0”
C.邏輯符號(hào)有小圓圈時(shí)，不用時(shí)接高電平“1”，沒(méi)有小圓圈時(shí)，不用時(shí)接低電平“0”
D.沒(méi)有記憶功能
A.有
B.無(wú)
C.時(shí)有時(shí)無(wú)
D.不確定
A.基本RS觸發(fā)器
B.D鎖存器
C.主從JK觸發(fā)器
D.邊沿JK觸發(fā)器
最新試題
邏輯函之間滿(mǎn)足（）關(guān)系。
?數(shù)字設(shè)計(jì)的層次主要有（）。
對(duì)于D觸發(fā)器，如果時(shí)鐘頻率為10MHz，輸出信號(hào)Q的頻率可能是（）MHz。
?兩個(gè)二進(jìn)制數(shù)的補(bǔ)碼相加，有溢出的是（）。
?若集成塊內(nèi)部為驅(qū)動(dòng)單元提供的驅(qū)動(dòng)能力為1X，對(duì)于下圖所示的輸出緩沖設(shè)計(jì)（圖中反相器上面標(biāo)注了相應(yīng)的驅(qū)動(dòng)能力），該輸出單元的延遲時(shí)間（從a到y(tǒng)）相當(dāng)于（）個(gè)內(nèi)部標(biāo)準(zhǔn)門(mén)級(jí)聯(lián)的延遲時(shí)間。
TTL門(mén)電路具有負(fù)載能力強(qiáng)、抗干擾能力強(qiáng)和轉(zhuǎn)換速度高等特點(diǎn)。
如圖，是151的電路設(shè)計(jì)，其中輸入端的使用了6個(gè)反相器，而實(shí)現(xiàn)邏輯功能應(yīng)該可以省掉三個(gè)，為什么這么設(shè)計(jì)（）。
為實(shí)現(xiàn)將D觸發(fā)器轉(zhuǎn)換為T(mén)觸發(fā)器，下圖所示電路的虛框內(nèi)應(yīng)是（）。
電路結(jié)構(gòu)如圖所示，該電路是（）。
?下圖邏輯單元實(shí)現(xiàn)的功能為（）。