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A.各通道最大流量的最大值
B.各通道最大流量之和
C.各通道實際流量的最大值
D.各通道實際流量之和
A.字節(jié)多路通道或選擇通道
B.字節(jié)多路通道或數(shù)組多路通道
C.選擇通道或數(shù)組多路通道
D.任意一種通道
A.訪管中斷
B.I/O中斷
C.程序性中斷
D.外部中斷
A.程序控制輸入輸出方式
B.中斷輸入輸出方式
C.直接存儲器訪問方式
D.上述3種方式
A.增加cache中的塊數(shù)
B.增大組的大小
C.增大主存容量
D.增大塊的大小
最新試題
有一個16KB4路組相聯(lián)Cache的32位微處理器，假定該Cache的塊為4個32位的字。主存地址為ABCDE8F8的單元在Cache中的什么位置。
為了使存儲系統(tǒng)的訪問效率達到0.94，命中率和等效訪問周期應該提高到多少？
設16個處理器編號分別為0，1，…，15，要用單級互連網(wǎng)絡，當互連函數(shù)分別為：（1）Cube3（Cube1）（5）Butterfly（Butterfly）（8）σ-1（9）β（1）（13）ρ（2）時，第13號處理器分別與哪一個處理器相連？
僅根據(jù)使用頻度，不考慮其它要求，設計出全Huffman操作碼，計算其平均碼長。
設計8位字長的寄存器—寄存器型指令3條，16位字長的寄存器一存儲器型變址尋址方式指令4條，變址范圍不小于正、負127。請設計指令格式，并給出指令各字段的長度和操作碼的編碼。
求出流水線的最優(yōu)調(diào)度策略及最小平均延遲時間和流水線的最大吞吐率。
如果在程序執(zhí)行過程中訪問一個頁面，平均要對該頁面內(nèi)的存儲單元訪問1024次，求訪問存儲單元的命中率。
若Cache的4個塊號為C0、C1、C2和C3，列出程序執(zhí)行過程中的Cache塊地址流。
若采用FIFO替換算法，計算Cache的塊命中率。
要求操作碼的平均長度最短，請設計操作碼的編碼，并計算操作碼編碼的平均長度。