單項(xiàng)選擇題組合邏輯電路的競(jìng)爭(zhēng)-冒險(xiǎn)是由于（）引起的。
A.電路不是最簡(jiǎn)
B.電路有多個(gè)輸出
C.電路中存在延遲
D.電路使用不同的門電路
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1.單項(xiàng)選擇題在組合邏輯電路的常用設(shè)計(jì)方法中，可以用（）來(lái)表示邏輯抽象的結(jié)果。
A.真值表
B.狀態(tài)表
C.狀態(tài)圖
D.特性方程
2.單項(xiàng)選擇題在下列電路中，只有（）屬于組合邏輯電路。
A.觸發(fā)器
B.計(jì)數(shù)器
C.數(shù)據(jù)選擇器
D.寄存器
3.單項(xiàng)選擇題用低電平為輸出有效的譯碼器實(shí)現(xiàn)組合邏輯電路時(shí)，還需要（）。
A.與非門
B.或非門
C.與門
D.或門
4.單項(xiàng)選擇題用高電平為輸出有效的譯碼器實(shí)現(xiàn)組合邏輯電路時(shí)，還需要（）。
A.與非門
B.或非門
C.與門
D.或門
5.單項(xiàng)選擇題在二進(jìn)制譯碼器中，若輸入有4位代碼，則輸出有（）信號(hào)。
A.2個(gè)
B.4個(gè)
C.8個(gè)
D.16個(gè)
最新試題
TTL與非門閾值電壓UT的典型值是（）
題型：?jiǎn)雾?xiàng)選擇題
以下哪個(gè)編碼不能是二－十進(jìn)制譯碼器的輸入編碼（）
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如果把D觸發(fā)器的輸出Q反饋連接到輸入D，則輸出Q的脈沖波形的頻率為CP脈沖頻率f的（）。
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兩個(gè)與非門構(gòu)成的基本RS觸發(fā)器，當(dāng)Q=1、Q=0時(shí)，兩個(gè)輸入信號(hào)R=1和S=1。觸發(fā)器的輸出Q會(huì)（）。
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采用浮柵技術(shù)的EPROM中存儲(chǔ)的數(shù)據(jù)是（）可擦除的。
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用1M×4的DRAM芯片通過(guò)（）擴(kuò)展可以獲得4M×8的存儲(chǔ)器。
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7系列EPROM存儲(chǔ)的數(shù)據(jù)是（）可擦除的。
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以下代碼中為無(wú)權(quán)碼的為（）。
題型：?jiǎn)雾?xiàng)選擇題