A.噪聲容限低
B.電源適用范圍寬
C.功耗極低
D.扇出能力強(qiáng)
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A.微功耗
B.高速度
C.高抗干擾能力
D.電源范圍寬
A.降低飽和深度
B.增加飽和深度
C.采用有源泄放回路
D.采用抗飽和三極管
A.懸空
B.通過(guò)電阻2.7kΩ接電源
C.通過(guò)電阻2.7kΩ接地
D.通過(guò)電阻510Ω接地
A.正或門
B.正非門
C.正與門
D.負(fù)或門
A.TSL門
B.OC門
C.漏極開(kāi)路門
D.CMOS與非門
A.與非門
B.三態(tài)輸出門
C.集電極開(kāi)路門
D.漏極開(kāi)路門
A.用電壓表測(cè)量指針不動(dòng)
B.相當(dāng)于懸空
C.電壓不高不低
D.測(cè)量電阻指針不動(dòng)
A.并聯(lián)比較型
B.逐次逼近型
C.雙積分型
D.施密特觸發(fā)器
A.采樣
B.量化
C.保持
D.編碼
A.采樣
B.量化
C.保持
D.編碼
最新試題
利用2個(gè)74LS138和1個(gè)非門,可以擴(kuò)展得到1個(gè)()線譯碼器。
兩個(gè)與非門構(gòu)成的基本RS觸發(fā)器,當(dāng)Q=1、Q=0時(shí),兩個(gè)輸入信號(hào)R=1和S=1。觸發(fā)器的輸出Q會(huì)()。
判斷如下VHDL的操作是否正確,如不正確,請(qǐng)改正。字符a和b的數(shù)據(jù)類型是BIT,c是INTEGER,執(zhí)行c<=a+b。
TTL與非門輸入短路電流IIS的參數(shù)規(guī)范值是()。
小容量RAM內(nèi)部存儲(chǔ)矩陣的字?jǐn)?shù)與外部地址線數(shù)n的關(guān)系一般為()
根據(jù)什么判斷簡(jiǎn)單電路中的險(xiǎn)象存在?
要使JK觸發(fā)器的輸出Q從1就成0,它的輸入信號(hào)JK就為()。
TTL與非門輸出高電平的參數(shù)規(guī)范值是()
如要將一個(gè)最大幅度為5.1V的模擬信號(hào)轉(zhuǎn)換為數(shù)字信號(hào),要求輸入每變化20mV,輸出信號(hào)的最低位(LSB)發(fā)生變化,應(yīng)選用()位ADC。
具有“有1出0、全0出1”功能的邏輯門是()