A.下降沿觸發(fā)的JK觸發(fā)器
B.維持-阻塞結(jié)構(gòu)的D觸發(fā)器
C.主從RS觸發(fā)器
D.T觸發(fā)器
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B.同步RS觸發(fā)器
C.主從RS觸發(fā)器
D.基本RS觸發(fā)器
A.有2個穩(wěn)定狀態(tài),即0態(tài)和1態(tài)
B.觸發(fā)器除了可以置0和置1外,還可以置為高阻態(tài)。
C.在外加輸入信號的觸發(fā)下,觸發(fā)器可以改變原來的狀態(tài),具有置0和置1功能。
D.沒有外加信號作用時,觸發(fā)器可以保持原來的狀態(tài)不變。
A.基本RS觸發(fā)器
B.D觸發(fā)器
C.主從JK觸發(fā)器
D.邊沿JK觸發(fā)器
最新試題
TTL與非門輸出高電平的參數(shù)規(guī)范值是()
一個兩輸入端的門電路,當(dāng)輸入為10時,輸出不是1的門電路為()
小容量RAM內(nèi)部存儲矩陣的字?jǐn)?shù)與外部地址線數(shù)n的關(guān)系一般為()
10-4線優(yōu)先編碼器允許同時輸入()路編碼信號。
TTL與非門輸入短路電流IIS的參數(shù)規(guī)范值是()。
TTL與非門閾值電壓UT的典型值是()
如要將一個最大幅度為5.1V的模擬信號轉(zhuǎn)換為數(shù)字信號,要求輸入每變化20mV,輸出信號的最低位(LSB)發(fā)生變化,應(yīng)選用()位ADC。
試提出數(shù)字頻率計(jì)的三種設(shè)計(jì)方案,比較各種方案的特點(diǎn)。如果用HDPLD來實(shí)現(xiàn),設(shè)計(jì)方案是最佳嗎?簡述理由。
用原碼輸出的譯碼器實(shí)現(xiàn)多輸出邏輯函數(shù),需要增加若干個()。
具有“有1出0、全0出1”功能的邏輯門是()