A.3個(gè)階段執(zhí)行時(shí)間之和
B.3個(gè)階段執(zhí)行時(shí)間的平均值
C.3個(gè)階段執(zhí)行時(shí)間的最小值
D.3個(gè)階段執(zhí)行時(shí)間的最大值
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A.為0
B.為1個(gè)周期
C.相等
D.不等
A.順序
B.重疊
C.循環(huán)
D.并行
A.由軟件實(shí)現(xiàn),考慮到實(shí)現(xiàn)很簡(jiǎn)便
B.由硬件實(shí)現(xiàn),考慮到實(shí)現(xiàn)速度要快
C.由軟件和硬件組合實(shí)現(xiàn),考慮到性價(jià)比要高
D.既可以用軟件實(shí)現(xiàn),也可以用硬件實(shí)現(xiàn),考慮到實(shí)現(xiàn)的靈活性
A.指令寄存器IR
B.程序計(jì)數(shù)器PC
C.算術(shù)邏輯單元ALU
D.程序狀態(tài)字寄存器PSW
A.960
B.873
C.1371
D.480
最新試題
控制器是構(gòu)成CPU的核心部件之一,它由多個(gè)硬件組成,而(1)不是構(gòu)成控制器的部件。目前cache已經(jīng)成為CPU的重要組成部分之一,在下面的關(guān)于cache的描述中,(2)是正確的??瞻祝?)處應(yīng)選擇()
先進(jìn)行地址計(jì)算,再訪問內(nèi)存的尋址方式是()。
在計(jì)算機(jī)中,保存當(dāng)前正在執(zhí)行的指令的寄存器為(1),存放當(dāng)前指令地址的寄存器叫(2)。在順序執(zhí)行指令的情況下(存儲(chǔ)器按字節(jié)編址,指令字長(zhǎng)32位),每執(zhí)行一條指令,使程序計(jì)數(shù)器自動(dòng)加(3)。算術(shù)邏輯運(yùn)算的結(jié)果通常放在(4)中。空白(2)處應(yīng)選擇()
在高速計(jì)算機(jī)中,廣泛采用流水線技術(shù)。例如,可以將指令執(zhí)行分成取指令、分析指令和執(zhí)行指令3個(gè)階段,不同指令的不同階段可以(1)執(zhí)行;各階段的執(zhí)行時(shí)間最好(2);否則在流水線運(yùn)行時(shí),每個(gè)階段的執(zhí)行時(shí)間應(yīng)取(3)。空白(1)處應(yīng)選擇()
計(jì)算機(jī)的存儲(chǔ)器采用多級(jí)方式是為了()。
運(yùn)算器是CPU的核心部件之一,其主要功能是()。
若內(nèi)存按字節(jié)編址,用存儲(chǔ)容量為4Kb×8的存儲(chǔ)器芯片構(gòu)成地址編號(hào)8000H至FFFFH的內(nèi)存空間,則至少需要()片。
如果主存容量為16MB,且按字節(jié)編址,表示該主存地址至少應(yīng)需要()位。
下列部件中不屬于輸入設(shè)備的有(1)。既可作為輸入設(shè)備,又可以作為輸出設(shè)備的是(2)。空白(1)處應(yīng)選擇()
下列敘述中正確的是()。