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A.地址寄存器
B.地址寄存器和指令寄存器
C.地址寄存器和數(shù)據(jù)緩沖寄存器
D.地址寄存器、數(shù)據(jù)緩沖寄存器和指令寄存器
A.階碼部件可實現(xiàn)加、減、乘、除四種運算
B.階碼部件只進(jìn)行階碼相加、相減和比較操作
C.階碼部件只進(jìn)行階碼相加、相減操作
D.尾數(shù)部件只進(jìn)行乘法和除法運算
A.一個以上,與非門
B.一個,三態(tài)緩沖器
C.n個,三態(tài)緩沖器
D.n個以上,或非門
A.非晶硅
B.單晶硅
C.多晶硅
D.硫化鎘
最新試題
畫出其中一組的邏輯圖。
如果在程序執(zhí)行過程中訪問一個頁面,平均要對該頁面內(nèi)的存儲單元訪問1024次,求訪問存儲單元的命中率。
浮點數(shù)系統(tǒng)使用的階碼基值re=2,階值位數(shù)q=2,尾數(shù)基值rm=10,尾數(shù)位數(shù)p′=1,即按照使用的二進(jìn)制位數(shù)來說,等價于p=4。計算在非負(fù)階、正尾數(shù)、規(guī)格化情況下的最小尾數(shù)值、最大尾數(shù)值、最大階值、可表示的最小值和最大值及可表示數(shù)的個數(shù)。
假設(shè)在3000次訪存中,第一級Cache不命中110次,第二級Cache不命中55次。試問:在這種情況下,該Cache系統(tǒng)的局部不命中率和全局不命中率各是多少?
若Cache的4個塊號為C0、C1、C2和C3,列出程序執(zhí)行過程中的Cache塊地址流。
一臺機器要求浮點數(shù)的字長的精度不低于10-7.2,表數(shù)的范圍正數(shù)不小于1038,且正負(fù)對稱。尾數(shù)用原碼、純小數(shù)表示,階碼用移碼、整數(shù)表示。設(shè)計這種浮點數(shù)的格式。
若對數(shù)字0~9和空格采用二進(jìn)制編碼,試設(shè)計編碼平均長度最短的編碼。
為了使存儲系統(tǒng)的訪問效率達(dá)到0.94,命中率和等效訪問周期應(yīng)該提高到多少?
若采用LRU替換算法,計算Cache的塊命中率。
若傳送106個文字符號,且每個文字符號后均自動跟一個空格,按最短的編碼,共需傳送多少個二進(jìn)制位?若傳送波特率為9600bPS,共需傳送多少時間?