單項選擇題低密度可編程邏輯器件（PLD）通常集成規(guī)模小于（）門。
A.100
B.1000
C.10000
D.10000
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1.單項選擇題兩模數(shù)分別為M1和M2的計數(shù)器串接而構(gòu)成的計數(shù)器，其總模數(shù)為（）。
A.M1＋M2
B.M1×M2
C.M1—M2
D.M1％M2
2.單項選擇題程序控制中，常用（）電路作定時器。
A.計數(shù)器
B.比較器
C.譯碼器
D.編碼器
3.單項選擇題欲把一脈沖信號延遲8個TCP后愉出，宜采用（）電路。
A.計數(shù)器
B.分頻器
C.移位寄存器
D.脈沖發(fā)生器
4.單項選擇題用集成計數(shù)器設(shè)計n進(jìn)制計數(shù)器時，不宜采用（）方法。
A.置最小數(shù)
B.反饋復(fù)位
C.反饋預(yù)置
D.時鐘禁止
5.單項選擇題欲把36kHz的脈沖信號變?yōu)?Hz的脈沖信號，若采用十進(jìn)制集成計數(shù)器，則各級的分頻系數(shù)為（）。
A.（3，6，10，10，10）
B.（4，9，10，10，10）
C.（3，12，10，10，10）
D.（6，3，10，10，10）
最新試題
試提出數(shù)字頻率計的三種設(shè)計方案，比較各種方案的特點。如果用HDPLD來實現(xiàn)，設(shè)計方案是最佳嗎？簡述理由。
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小容量RAM內(nèi)部存儲矩陣的字?jǐn)?shù)與外部地址線數(shù)n的關(guān)系一般為（）
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用原碼輸出的譯碼器實現(xiàn)多輸出邏輯函數(shù)，需要增加若干個（）。
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與倒T形電阻網(wǎng)絡(luò)DAC相比，權(quán)電流網(wǎng)絡(luò)D/A轉(zhuǎn)換器的主要優(yōu)點是消除了（）對轉(zhuǎn)換精度的影響。
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