單項選擇題PLA是指（）。
A.可編程邏輯陣列
B.可編程陣列邏輯
C.通用陣列邏輯
D.專用陣列邏輯
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1.單項選擇題用PLA進(jìn)行邏輯設(shè)計時，應(yīng)將邏輯函數(shù)表達(dá)式變換成（）式。
A.與非與非
B.異或
C.最簡與或
D.最簡或與
2.單項選擇題在下列器件中，不屬于PLD的器件是（）。
A.PROM
B.EPROM
C.SRAM
D.PLA
3.單項選擇題不屬于PLD基本結(jié)構(gòu)部分的是（）。
A.與門陣列
B.或門陣列
C.與非門陣列
D.輸入緩沖器
4.單項選擇題PLD（可編程邏輯器件）屬于（）電路。
A.非用戶定制
B.全用戶定制
C.半用戶定制
D.自動生成
5.單項選擇題邏輯器件（）屬于非用戶定制電路。
A.邏輯門
B.GAL
C.PROM
D.PLA
最新試題
與倒T形電阻網(wǎng)絡(luò)DAC相比，權(quán)電流網(wǎng)絡(luò)D/A轉(zhuǎn)換器的主要優(yōu)點是消除了（）對轉(zhuǎn)換精度的影響。
題型：單項選擇題
基本RS觸發(fā)器的輸入直接控制其輸出狀態(tài)，所以它不能被稱為（）觸發(fā)器。
題型：單項選擇題
如要將一個最大幅度為5.1V的模擬信號轉(zhuǎn)換為數(shù)字信號，要求輸入每變化20mV，輸出信號的最低位（LSB）發(fā)生變化，應(yīng)選用（）位ADC。
題型：單項選擇題
用原碼輸出的譯碼器實現(xiàn)多輸出邏輯函數(shù)，需要增加若干個（）。
題型：單項選擇題
一個兩輸入端的門電路，當(dāng)輸入為10時，輸出不是1的門電路為（）
題型：單項選擇題
簡述用譯碼器或多路選擇器實現(xiàn)組合邏輯電路的不同之處。
題型：問答題
雙積分型數(shù)字電壓表是否需要取樣-保持電路？請說明理由。
題型：問答題
小容量RAM內(nèi)部存儲矩陣的字?jǐn)?shù)與外部地址線數(shù)n的關(guān)系一般為（）
題型：單項選擇題
用1M×4的DRAM芯片通過（）擴(kuò)展可以獲得4M×8的存儲器。
題型：單項選擇題
如果把D觸發(fā)器的輸出Q反饋連接到輸入D，則輸出Q的脈沖波形的頻率為CP脈沖頻率f的（）。
題型：單項選擇題