單項選擇題在下列器件中，不屬于PLD的器件是（）。
A.PROM
B.EPROM
C.SRAM
D.PLA
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1.單項選擇題不屬于PLD基本結(jié)構(gòu)部分的是（）。
A.與門陣列
B.或門陣列
C.與非門陣列
D.輸入緩沖器
2.單項選擇題PLD（可編程邏輯器件）屬于（）電路。
A.非用戶定制
B.全用戶定制
C.半用戶定制
D.自動生成
3.單項選擇題邏輯器件（）屬于非用戶定制電路。
A.邏輯門
B.GAL
C.PROM
D.PLA
4.單項選擇題在A/D轉(zhuǎn)換器中，已知是量化單位，若采用“有舍有取”方法劃分量化電平，則量化誤差為（）。
A.1／4
B.1／2
C.1
D.2
5.單項選擇題已知Tcp是8位逐次漸近型A／D轉(zhuǎn)換器的輸入時鐘周期，則完成一次轉(zhuǎn)換需要的時間是（）Tcp。
A.8
B.9
C.10
D.11
最新試題
判斷如下VHDL的操作是否正確，如不正確，請改正。字符a和b的數(shù)據(jù)類型是BIT，c是INTEGER，執(zhí)行c＜=a+b。
題型：問答題
27系列EPROM存儲的數(shù)據(jù)是（）可擦除的。
題型：單項選擇題
小容量RAM內(nèi)部存儲矩陣的字?jǐn)?shù)與外部地址線數(shù)n的關(guān)系一般為（）
題型：單項選擇題
TTL與非門輸出低電平的參數(shù)規(guī)范值是（）
題型：單項選擇題
如要將一個最大幅度為5.1V的模擬信號轉(zhuǎn)換為數(shù)字信號，要求輸入每變化20mV，輸出信號的最低位（LSB）發(fā)生變化，應(yīng)選用（）位ADC。
題型：單項選擇題
兩個與非門構(gòu)成的基本RS觸發(fā)器，當(dāng)Q=1、Q=0時，兩個輸入信號R=1和S=1。觸發(fā)器的輸出Q會（）。
題型：單項選擇題
簡述用譯碼器或多路選擇器實現(xiàn)組合邏輯電路的不同之處。
題型：問答題
以下哪個編碼不能是二－十進制譯碼器的輸入編碼（）
題型：單項選擇題
TTL與非門輸出高電平的參數(shù)規(guī)范值是（）
題型：單項選擇題
ROM可以用來存儲程序、表格和大量固定數(shù)據(jù)，但它不可以用來實現(xiàn)（）。
題型：單項選擇題