A.原碼
B.反碼
C.補(bǔ)碼
D.編碼
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A.器件的狀態(tài)
B.電平的高低
C.脈沖的有無(wú)
D.數(shù)量的大小
A.電路結(jié)構(gòu)簡(jiǎn)單,有利于實(shí)現(xiàn)電路集成化;
B.可實(shí)現(xiàn)邏輯運(yùn)算和判斷;
C.工作穩(wěn)定抗干擾能力強(qiáng);
D.工作于開(kāi)關(guān)狀態(tài),功耗低。
A.全部輸入是0
B.全部輸入是1
C.任一輸入為0,其他輸入為1
D.任一輸入為1
A.“·”換成“+”,“+”換成“·”
B.原變量換成反變量,反變量換成原變量
C.變量不變
D.常數(shù)中“0”換成“1”,“1”換成“0”
A.“1”格允許被一個(gè)以上的圈所包圍。
B.“1”格不能漏畫(huà)。
C.圈的個(gè)數(shù)要盡量少,圈的面積應(yīng)盡量的大。
D.每圈必有一個(gè)新“1“格。
最新試題
用1M×4的DRAM芯片通過(guò)()擴(kuò)展可以獲得4M×8的存儲(chǔ)器。
要使JK觸發(fā)器的輸出Q從1就成0,它的輸入信號(hào)JK就為()。
以下哪個(gè)編碼不能是二-十進(jìn)制譯碼器的輸入編碼()
TTL與非門(mén)輸出高電平的參數(shù)規(guī)范值是()
()在計(jì)算機(jī)系統(tǒng)中得到了廣泛的應(yīng)用,其中一個(gè)重要用途是構(gòu)成數(shù)據(jù)總線。
10-4線優(yōu)先編碼器允許同時(shí)輸入()路編碼信號(hào)。
雙積分型數(shù)字電壓表是否需要取樣-保持電路?請(qǐng)說(shuō)明理由。
一個(gè)VHDL模塊是否必須有一個(gè)實(shí)體和一個(gè)結(jié)構(gòu)體?是否可以有多個(gè)實(shí)體和結(jié)構(gòu)體?簡(jiǎn)述它們的作用。
若停電數(shù)分鐘后恢復(fù)供電,()中的信息能夠保持不變。
一個(gè)16選一的數(shù)據(jù)選擇器,其地址輸入(選擇控制輸入)端有()個(gè)。