A.BOOL
B.REAL
C.STRUCT
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A.SR
B.SEL
C.RS
D.ABS
A.TOF
B.TON
C.TP
D.RTRIG
A.物理點(diǎn)
B.通訊點(diǎn)
C.功能塊點(diǎn)
D.中間點(diǎn)
E.局部點(diǎn)
F.引用點(diǎn)
A.軟件邏輯控制
B.功能圖索引號(hào)
C.系統(tǒng)標(biāo)識(shí)碼
D.信號(hào)流轉(zhuǎn)分配方式
A.xi表示有效性判斷，如果Bi=1則xi無(wú)效，其他情況xi均有效
B.xi中有四個(gè)有效，則Y=1
C.xi中有兩個(gè)有效，則Y=1
D.xi中有三個(gè)有效，則Y=1
最新試題
?具有3個(gè)選擇控制端的數(shù)據(jù)選擇器能對(duì)（）個(gè)輸入數(shù)據(jù)進(jìn)行選擇，對(duì)應(yīng)選擇輸入端的任何一種取值，可選中（）個(gè)輸入數(shù)據(jù)輸出。?
反映TTL與非門(mén)輸入高電平時(shí)抗干擾能力的外部特性參數(shù)是（）。
使用8路選擇器實(shí)現(xiàn)4變量邏輯函數(shù)F（A，B，C，D），使用ABC作為控制變量，數(shù)據(jù)輸入端D0-D7可能的值有（）。
下圖所示組合邏輯電路，其功能是（）。
假定某個(gè)電路如圖示，指示燈F和開(kāi)關(guān)A、B、C的邏輯關(guān)系表達(dá)式為（）。
?設(shè)計(jì)一個(gè)mealy型的110序列檢測(cè)器，需要（）個(gè)觸發(fā)器，而設(shè)計(jì)moore型的110序列檢測(cè)器則需要（）個(gè)觸發(fā)器。?
現(xiàn)場(chǎng)可編程門(mén)陣列FPGA的基本結(jié)構(gòu)由（）組成。
下面圖示的電路可以實(shí)現(xiàn)（）功能。
一個(gè)Moore型同步可重疊的“1011”序列檢測(cè)器的狀態(tài)圖是（）。
實(shí)現(xiàn)模（215）10的加法計(jì)數(shù)需要（）片74193。