單項選擇題?下列表達式中存在靜態(tài)1型冒險的有()。
A.A’+AB+B’D
B.(A’+B)(B’+C ’)
C.C+B+B’C
D.(A’+B’)(A’+C)
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1.單項選擇題?正邏輯與非門,用負邏輯表示時,則是()。
A.異或門
B.或門
C.或非門
D.與門
2.單項選擇題時鐘同步狀態(tài)機的時鐘周期,至少應大于()。
A.觸發(fā)器延遲時間+下一狀態(tài)邏輯(組合電路)的延遲時間
B.下一狀態(tài)邏輯(組合電路)的延遲時間+觸發(fā)器的保持時間
C.下一狀態(tài)邏輯(組合電路)的延遲時間+觸發(fā)器的建立時間
D.觸發(fā)器延遲時間+下一狀態(tài)邏輯(組合電路)的延遲時間+觸發(fā)器的建立時間
3.單項選擇題
下圖中哪個狀態(tài)是沒有二義性的?()
A.A
B.B
C.C
D.D
4.多項選擇題狀態(tài)圖應該是明確的,其輸出弧線上的表達式應滿足()。
A.互斥性
B.多樣性
C.完備性
D.同步性
5.多項選擇題等價狀態(tài)是指()。
A.在所有輸入組合下,都產(chǎn)生相同的輸出
B.對每一個輸入,都具有相同或等效的下一狀態(tài)
C.在所有輸入組合下,一部分的輸出相同
D.對每一個輸入,具有一部分相同或等效的下一狀態(tài)
最新試題
?如圖電路,描述正確的是()。
題型:單項選擇題
如圖,此電路的輸入端I0_L是低電平有效,輸出A2A1A0是高電平有效,AVALID有效表示的是()。
題型:單項選擇題
要使TTL與非門變成反相器,多余的輸入端不能采用的方法為()。
題型:單項選擇題
為實現(xiàn)將D觸發(fā)器轉(zhuǎn)換為T觸發(fā)器,下圖所示電路的虛框內(nèi)應是()。
題型:單項選擇題
?如圖所示電路論述正確的是()。
題型:多項選擇題
要使CMOS門輸入高電平,不能使用的方法為()。
題型:單項選擇題
電路結構如圖所示,該電路是()。
題型:單項選擇題
如圖所示,則F=()。
題型:多項選擇題
如圖,是151的電路設計,其中輸入端的使用了6個反相器,而實現(xiàn)邏輯功能應該可以省掉三個,為什么這么設計()。
題型:單項選擇題
邏輯函之間滿足()關系。
題型:多項選擇題