單項(xiàng)選擇題十進(jìn)制數(shù)127.25對(duì)應(yīng)二進(jìn)制數(shù)為（）。
A.1111111.01
B.1000000010
C.111110.01
D.1100011.11
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1.單項(xiàng)選擇題?能夠表示任意一個(gè)三位十進(jìn)制數(shù)至少需要（）位二進(jìn)制數(shù)。
A.8
B.9
C.10
D.11
2.單項(xiàng)選擇題?一個(gè)4位移位寄存器原來的狀態(tài)為1111，如果串行輸入始終為0，則經(jīng)過4個(gè)移位脈沖后寄存器的內(nèi)容為（）
A.1110
B.0000
C.0111
D.0001
3.單項(xiàng)選擇題?以下觸發(fā)器類型，抗干擾性最好的是（）
A.邊沿觸發(fā)器
B.脈沖觸發(fā)器
C.SR鎖存器
D.電平觸發(fā)器
4.單項(xiàng)選擇題?能實(shí)現(xiàn)數(shù)據(jù)分配器功能的器件是（）
A.計(jì)數(shù)器
B.觸發(fā)器
C.譯碼器
D.數(shù)據(jù)選擇器
5.單項(xiàng)選擇題一個(gè)128選1的數(shù)據(jù)選擇器有（）個(gè)選擇控制信號(hào)輸入端。
A.7
B.128
C.16
D.32
最新試題
反映TTL與非門輸入高電平時(shí)抗干擾能力的外部特性參數(shù)是（）。
題型：?jiǎn)雾?xiàng)選擇題
現(xiàn)場(chǎng)可編程門陣列FPGA的基本結(jié)構(gòu)由（）組成。
題型：多項(xiàng)選擇題
通常，使用參數(shù)（）來衡量D/A轉(zhuǎn)換器的轉(zhuǎn)換速度。
題型：?jiǎn)雾?xiàng)選擇題
下圖所示的PLD連接表示的輸出函數(shù)表達(dá)式F等于（）。
題型：?jiǎn)雾?xiàng)選擇題
假定某個(gè)電路如圖示，指示燈F和開關(guān)A、B、C的邏輯關(guān)系表達(dá)式為（）。
題型：?jiǎn)雾?xiàng)選擇題
現(xiàn)場(chǎng)可編程門陣列FPGA的設(shè)計(jì)流程中，下列屬于規(guī)劃設(shè)計(jì)階段的工作有（）。
題型：多項(xiàng)選擇題
一個(gè)Moore型同步可重疊的“1011”序列檢測(cè)器的狀態(tài)圖是（）。
題型：?jiǎn)雾?xiàng)選擇題
下圖所示CMOS電路實(shí)現(xiàn)的邏輯是（）。
題型：?jiǎn)雾?xiàng)選擇題
使用8路選擇器實(shí)現(xiàn)4變量邏輯函數(shù)F（A，B，C，D），使用ABC作為控制變量，數(shù)據(jù)輸入端D0-D7可能的值有（）。
題型：多項(xiàng)選擇題
輸出端與輸出端可以直接連接，實(shí)現(xiàn)“線與”的門電路有（）。
題型：?jiǎn)雾?xiàng)選擇題