A.只讀
B.讀/寫
C.只寫
D.無讀/寫
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A.FLASH
B.SRAM
C.EEPROM
D.DRAM
A.2000B
B.2048B
C.4096B
D.4000B
A.置1
B.翻轉(zhuǎn)
C.置0
D.保持
A.D觸發(fā)器
B.T觸發(fā)器
C.JK觸發(fā)器
D.T′觸發(fā)器
A.邊沿觸發(fā)器的次態(tài)僅取決于時(shí)鐘有效邊沿到達(dá)時(shí)輸入的邏輯狀態(tài)。
B.脈沖觸發(fā)器的次態(tài)只考慮CLK下降沿到達(dá)時(shí)輸入的邏輯狀態(tài)，從而決定次態(tài)的變化。
C.觸發(fā)器與鎖存器的不同在于觸發(fā)器增加了一個(gè)觸發(fā)時(shí)鐘信號(hào)。
D.電平觸發(fā)的觸發(fā)器只有當(dāng)CLK變?yōu)橛行щ娖绞?，觸發(fā)器才能接受輸入信號(hào)，并按照輸入信號(hào)將觸發(fā)器的輸出置成相應(yīng)狀態(tài)。
最新試題
使用8路選擇器實(shí)現(xiàn)4變量邏輯函數(shù)F（A，B，C，D），使用ABC作為控制變量，數(shù)據(jù)輸入端D0-D7可能的值有（）。
下圖所示CMOS電路實(shí)現(xiàn)的邏輯是（）。
現(xiàn)場(chǎng)可編程門陣列FPGA的設(shè)計(jì)流程中，下列屬于規(guī)劃設(shè)計(jì)階段的工作有（）。
邏輯函數(shù)F（A，B，C，D）=∑m（2，7，8，12，13，14，15）的卡諾圖，下面畫法正確的是（）。
如下圖所示的原始狀態(tài)表，其中的等效對(duì)有（）。
通常，使用參數(shù)（）來衡量D/A轉(zhuǎn)換器的轉(zhuǎn)換速度。
下圖所示電路的功能是（）。
設(shè)計(jì)一個(gè)Moore型同步可重疊的“1101”序列檢測(cè)器，至少需要（）個(gè)觸發(fā)器。
一個(gè)n位的D/A換器的分辨率為（）。
下圖所示組合邏輯電路，其功能是（）。