多項(xiàng)選擇題欲使JK觸發(fā)器按Qn+1=Q’n工作，可使JK觸發(fā)器的輸入端（）。
A.J=K=1
B.J=Q，K=Q’
C.J=Q’，K=Q
D.J=Q，K=1
E.J=1，K=Q
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1.多項(xiàng)選擇題欲使JK觸發(fā)器按Qn+1=Qn工作，可使JK觸發(fā)器的輸入端（）。
A.J=K=0
B.J=Q，K=Q’
C.J=Q’，K=Q
D.J=Q，K=0
E.J=0，K=Q’
2.多項(xiàng)選擇題對于T觸發(fā)器，若現(xiàn)態(tài)Qn=1，欲使次態(tài)Qn+1=1，應(yīng)使輸入T=（）。
A.0
B.1
C.Q
D.Q’
3.多項(xiàng)選擇題對于T觸發(fā)器，若現(xiàn)態(tài)Qn=0，欲使次態(tài)Qn+1=1，應(yīng)使輸入T=（）。
A.0
B.1
C.Q
D.Q’
最新試題
如圖，是151的電路設(shè)計(jì)，其中輸入端的使用了6個反相器，而實(shí)現(xiàn)邏輯功能應(yīng)該可以省掉三個，為什么這么設(shè)計(jì)（）。
題型：單項(xiàng)選擇題
約束項(xiàng)在函數(shù)化簡時可以當(dāng)作1，是因?yàn)樵趯?shí)際電路中，這種輸入組合根本不可能會讓其發(fā)生。
題型：判斷題
要使CMOS門輸入高電平，不能使用的方法為（）。
題型：單項(xiàng)選擇題
?十進(jìn)制數(shù)178.5對應(yīng)的余3碼是（）。
題型：單項(xiàng)選擇題
對于D觸發(fā)器，如果時鐘頻率為10MHz，輸出信號Q的頻率可能是（）MHz。
題型：多項(xiàng)選擇題
如圖電路實(shí)現(xiàn)的邏輯函數(shù)是（）。
題型：多項(xiàng)選擇題
?當(dāng)共陰極7段數(shù)碼管顯示2的時候，輸出應(yīng)該為（）。
題型：單項(xiàng)選擇題
已知有二輸入邏輯門，只有當(dāng)輸X和Y都為1時，輸出F才為1，則X，Y與F的邏輯關(guān)系為（）。
題型：單項(xiàng)選擇題
邏輯函之間滿足（）關(guān)系。
題型：多項(xiàng)選擇題
?利用開關(guān)代數(shù)的公理或定理，判斷與（x+y’）’等價的邏輯關(guān)系為（）。
題型：單項(xiàng)選擇題