問答題比較PAL、GAL、CPLD及FPGA可編程邏輯器件各自的特點(diǎn)。

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已知函數(shù)F(A,B,C,D)=(AB’)’+(C’D+B’C)’,則其最簡(jiǎn)表達(dá)式為()。

題型:?jiǎn)雾?xiàng)選擇題

對(duì)于D觸發(fā)器,如果時(shí)鐘頻率為10MHz,輸出信號(hào)Q的頻率可能是()MHz。

題型:多項(xiàng)選擇題

與模擬電路相比,數(shù)字系統(tǒng)的優(yōu)越性主要體現(xiàn)在()。

題型:多項(xiàng)選擇題

電路結(jié)構(gòu)如圖所示,該電路是()。

題型:?jiǎn)雾?xiàng)選擇題

若n個(gè)變量的同或運(yùn)算和異或運(yùn)算結(jié)果相同,則n為奇數(shù)()

題型:判斷題

若集成塊內(nèi)部為驅(qū)動(dòng)單元提供的驅(qū)動(dòng)能力為1X,最小反相器(1X)延遲時(shí)間為2,對(duì)于下圖所示的輸出緩沖設(shè)計(jì)(圖中反相器上面標(biāo)注了相應(yīng)的驅(qū)動(dòng)能力),該輸出單元的延遲時(shí)間(從a到y(tǒng))最接近于()。

題型:?jiǎn)雾?xiàng)選擇題

使用74HC138實(shí)現(xiàn)邏輯函數(shù)正確的是()。

題型:?jiǎn)雾?xiàng)選擇題

要使JK觸發(fā)器在時(shí)鐘脈沖作用下,實(shí)現(xiàn)輸出,則輸入信號(hào)應(yīng)為()。

題型:?jiǎn)雾?xiàng)選擇題

?數(shù)字設(shè)計(jì)的層次主要有()。

題型:多項(xiàng)選擇題

?十進(jìn)制數(shù)22.37對(duì)應(yīng)的二進(jìn)制數(shù)是()。

題型:?jiǎn)雾?xiàng)選擇題