問答題
如下圖所示,主從結構的JK觸發(fā)器中,已知CP和輸入信號T的各電壓波形如下圖所示,試畫出Q和平均值Q端的電壓波形,并設觸發(fā)器的初態(tài)為Q=0。
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已知有二輸入邏輯門,只有當輸X和Y都為1時,輸出F才為1,則X,Y與F的邏輯關系為()。
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要使JK觸發(fā)器在時鐘脈沖作用下,實現(xiàn)輸出,則輸入信號應為()。
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使用74HC138實現(xiàn)邏輯函數(shù)正確的是()。
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邏輯函之間滿足()關系。
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CC4000系列的CMOS門電路不能直接接()系列的門電路。
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為實現(xiàn)將D觸發(fā)器轉(zhuǎn)換為T觸發(fā)器,下圖所示電路的虛框內(nèi)應是()。
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?下圖邏輯單元實現(xiàn)的功能為()。
題型:單項選擇題
若集成塊內(nèi)部為驅(qū)動單元提供的驅(qū)動能力為1X,最小反相器(1X)延遲時間為2,對于下圖所示的輸出緩沖設計(圖中反相器上面標注了相應的驅(qū)動能力),該輸出單元的延遲時間(從a到y(tǒng))最接近于()。
題型:單項選擇題
如圖所示,則F=()。
題型:多項選擇題
?利用開關代數(shù)的公理或定理,判斷與(x+y’)’等價的邏輯關系為()。
題型:單項選擇題