單項(xiàng)選擇題一個(gè)8選一數(shù)據(jù)選擇器的數(shù)據(jù)輸入端有（）個(gè)。
A.1
B.2
C.3
D.4
E.8
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1.單項(xiàng)選擇題四選一數(shù)據(jù)選擇器的數(shù)據(jù)輸出Y與數(shù)據(jù)輸入Xi和地址碼Ai之間的邏輯表達(dá)式為Y=（）
A.
B.
C.
D.
2.單項(xiàng)選擇題若在編碼器中有50個(gè)編碼對(duì)象，則要求輸出二進(jìn)制代碼位數(shù)為（）位。
A.5
B.6
C.10
D.50
3.單項(xiàng)選擇題以下電路中常用于總線應(yīng)用的有（）
A.TSL門
B.OC門
C.漏極開路門
D.CMOS與非門
4.單項(xiàng)選擇題以下電路中可以實(shí)現(xiàn)“線與”功能的有（）
A.與非門
B.三態(tài)輸出門
C.集電極開路門
D.CMOS與非門
5.單項(xiàng)選擇題在何種輸入情況下，“與非”運(yùn)算的結(jié)果是邏輯0。（）
A.全部輸入是0
B.任一輸入是0
C.僅一輸入是0
D.全部輸入是1
最新試題
?構(gòu)成數(shù)字電路最基本的器件主要有（）。
題型：多項(xiàng)選擇題
已知有二輸入邏輯門，只有當(dāng)輸X和Y都為1時(shí)，輸出F才為1，則X，Y與F的邏輯關(guān)系為（）。
題型：?jiǎn)雾?xiàng)選擇題
要使JK觸發(fā)器在時(shí)鐘脈沖作用下，實(shí)現(xiàn)輸出，則輸入信號(hào)應(yīng)為（）。
題型：?jiǎn)雾?xiàng)選擇題
?十進(jìn)制數(shù)178.5對(duì)應(yīng)的余3碼是（）。
題型：?jiǎn)雾?xiàng)選擇題
CC4000系列的CMOS門電路不能直接接（）系列的門電路。
題型：?jiǎn)雾?xiàng)選擇題
如圖電路實(shí)現(xiàn)的邏輯函數(shù)是（）。
題型：多項(xiàng)選擇題
?十進(jìn)制數(shù)22.37對(duì)應(yīng)的二進(jìn)制數(shù)是（）。
題型：?jiǎn)雾?xiàng)選擇題
已知函數(shù)F（A，B，C，D）=（AB’）’+（C’D+B’C）’，則其最簡(jiǎn)表達(dá)式為（）。
題型：?jiǎn)雾?xiàng)選擇題
要使TTL與非門變成反相器，多余的輸入端不能采用的方法為（）。
題型：?jiǎn)雾?xiàng)選擇題
?BCD碼譯碼器如果不允許輸入大于9的數(shù)值的時(shí)候，當(dāng)輸入10時(shí)，輸出為（）。
題型：?jiǎn)雾?xiàng)選擇題