分析下述程序，選擇正確的運行結(jié)果（）
A.A
B.B
C.C
D.D
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A.用于描述系統(tǒng)內(nèi)部的結(jié)構(gòu)和行為
B.用于描述系統(tǒng)外部的結(jié)構(gòu)和行為
C.用于描述系統(tǒng)內(nèi)部和外部的結(jié)構(gòu)和行為
D.用于描述系統(tǒng)內(nèi)部的結(jié)構(gòu)
A.用于描述所設(shè)計系統(tǒng)的外部接口信號
B.用于描述所設(shè)計系統(tǒng)的內(nèi)部接口信號
C.用于描述所設(shè)計系統(tǒng)的內(nèi)部和外部接口信號
D.用于描述所設(shè)計系統(tǒng)的外部輸入信號
下述根據(jù)VHDL進(jìn)行的I/O名稱定義中，哪個是正確的（）
A.A
B.B
C.C
D.D
A.a.pof
B.a.sof
C.a.jed
D.a.rpt
A.a.gdf
B.a.vhd
C.a.wdf
D.a.sch
最新試題
輸出端不能直接線與的門電路有（）。
?如圖電路，描述正確的是（）。
如圖，是151的電路設(shè)計，其中輸入端的使用了6個反相器，而實現(xiàn)邏輯功能應(yīng)該可以省掉三個，為什么這么設(shè)計（）。
要使TTL與非門變成反相器，多余的輸入端不能采用的方法為（）。
二進(jìn)制加法運算包含的輸入、輸出變量有（）。
?若集成塊內(nèi)部為驅(qū)動單元提供的驅(qū)動能力為1X，對于下圖所示的輸出緩沖設(shè)計（圖中反相器上面標(biāo)注了相應(yīng)的驅(qū)動能力），該輸出單元的延遲時間（從a到y(tǒng)）相當(dāng)于（）個內(nèi)部標(biāo)準(zhǔn)門級聯(lián)的延遲時間。
如圖，此電路的輸入端I0_L是低電平有效，輸出A2A1A0是高電平有效，AVALID有效表示的是（）。
若集成塊內(nèi)部為驅(qū)動單元提供的驅(qū)動能力為1X，最小反相器（1X）延遲時間為2，對于下圖所示的輸出緩沖設(shè)計（圖中反相器上面標(biāo)注了相應(yīng)的驅(qū)動能力），該輸出單元的延遲時間（從a到y(tǒng)）最接近于（）。
?構(gòu)成數(shù)字電路最基本的器件主要有（）。
CC4000系列的CMOS門電路不能直接接（）系列的門電路。