函數(shù)F=
，當(dāng)變量取值為（），不會(huì)出現(xiàn)冒險(xiǎn)現(xiàn)象。
A.B=C=1
B.B=C=0
C.A=1，C=0
D.A=B=0
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已知邏輯函數(shù)的卡諾圖如圖所示能實(shí)現(xiàn)這一函數(shù)功能的電路是（）
A.
B.
C.
D.
如圖所示的波形圖表示的邏輯關(guān)系是（）
A.F=A*B
B.F=A+B
C.
D.
如圖所示門(mén)電路，按正邏輯體制，電路實(shí)現(xiàn)的邏輯關(guān)系F=（）
A.
B.A*B*C
C.A+B+C
D.
A.（00101100）余3BCD
B.（01001100）余3BCD
C.（00110101）余3BCD
D.（01011010）余3BCD
最新試題
下圖所示的PLD連接表示的輸出函數(shù)表達(dá)式F等于（）。
電平異步時(shí)序邏輯電路工作的基本條件有（）。
使用8路選擇器實(shí)現(xiàn)4變量邏輯函數(shù)F（A，B，C，D），使用ABC作為控制變量，數(shù)據(jù)輸入端D0-D7可能的值有（）。
?已知脈沖異步時(shí)序邏輯電路如下圖所示，其功能是（）。
?如下圖所示時(shí)序電路，該電路是一個(gè)（）型電路，其功能是（）。
對(duì)于一個(gè)輸入為XYZ的脈沖異步時(shí)序邏輯電路，下面的輸入脈沖組合中，（）是允許的。
?設(shè)計(jì)一個(gè)mealy型的110序列檢測(cè)器，需要（）個(gè)觸發(fā)器，而設(shè)計(jì)moore型的110序列檢測(cè)器則需要（）個(gè)觸發(fā)器。?
反映TTL與非門(mén)輸入高電平時(shí)抗干擾能力的外部特性參數(shù)是（）。
?用3線-8線譯碼器74138（邏輯符號(hào)如下圖所示）和與非門(mén)實(shí)現(xiàn)函數(shù)的功能時(shí)，74138的輸出端（）連接與非門(mén)。?
設(shè)計(jì)一個(gè)判斷輸入8421碼表示的十進(jìn)制數(shù)是否大于5的組合邏輯電路，至少需要（）個(gè)邏輯門(mén)。