A.1
B.2
C.3
D.4
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下圖所示組合邏輯電路，輸入ABCD為8421碼，則電路的輸出WXYZ是（）。
A.余3碼
B.8421碼對9的補(bǔ)數(shù)
C.8421碼對6的補(bǔ)數(shù)
D.2421碼
下圖所示組合邏輯電路，其功能是（）。
A.8421碼轉(zhuǎn)余3碼
B.8421碼轉(zhuǎn)2421碼
C.二進(jìn)制碼轉(zhuǎn)格雷碼
D.二進(jìn)制碼轉(zhuǎn)8421碼
下圖所示CMOS電路實(shí)現(xiàn)的邏輯是（）。
A.
B.
C.
D.
A.TTL與非門
B.CMOS與非門
C.集電極開路與非門
D.CMOS傳輸門
A.開門電平
B.關(guān)門電平
C.扇入系數(shù)
D.扇出系數(shù)
最新試題
?已知描述某同步時(shí)序電路的狀態(tài)圖如下圖所示，假定輸入序列為x=01011011，初始狀態(tài)為A，則電路的狀態(tài)序列為（），輸出響應(yīng)序列為（）。
下圖所示組合邏輯電路，其功能是（）。
在正常工作時(shí)，3-8線譯碼器74138的使能端的值為（）。
電平異步時(shí)序邏輯電路工作的基本條件有（）。
下圖所示電路的功能是（）。
用PROM設(shè)計(jì)一個(gè)2位二進(jìn)制平方器，實(shí)現(xiàn)該平方器需要的容量至少為（）。
設(shè)計(jì)一個(gè)判斷輸入8421碼表示的十進(jìn)制數(shù)是否大于5的組合邏輯電路，至少需要（）個(gè)邏輯門。
如下圖所示的原始狀態(tài)表，其中的等效對有（）。
為了實(shí)現(xiàn)計(jì)數(shù)功能，集成寄存器74194的控制端S0S1可以是（）。
下圖所示CMOS電路實(shí)現(xiàn)的邏輯是（）。