A.（00101100）余3BCD
B.（01001100）余3BCD
C.（00110101）余3BCD
D.（01011010）余3BCD
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下圖所示組合邏輯電路，其功能是（）。
A.8421碼轉(zhuǎn)余3碼
B.8421碼轉(zhuǎn)2421碼
C.二進(jìn)制碼轉(zhuǎn)格雷碼
D.二進(jìn)制碼轉(zhuǎn)8421碼
A.1
B.2
C.3
D.4
下圖所示CMOS電路實(shí)現(xiàn)的邏輯是（）。
A.
B.
C.
D.
A.TTL與非門(mén)
B.CMOS與非門(mén)
C.集電極開(kāi)路與非門(mén)
D.CMOS傳輸門(mén)
假定某個(gè)電路如圖示，指示燈F和開(kāi)關(guān)A、B、C的邏輯關(guān)系表達(dá)式為（）。
A.
B.
C.
D.
A.001
B.011
C.111
D.100
A.n
B.2n
C.
D.
A.1；2
B.2；2
C.2；3
D.3；4
在正常工作時(shí)，3-8線譯碼器74138的使能端
的值為（）。
A.000
B.100
C.011
D.111
下面圖示的電路可以實(shí)現(xiàn)（）功能。
A.二進(jìn)制模十計(jì)數(shù)器
B.8421碼模十計(jì)數(shù)器
C.5421碼模十計(jì)數(shù)器
D.2421模十計(jì)數(shù)器
最新試題
一個(gè)n位的D/A換器的分辨率為（）。
使用8路選擇器實(shí)現(xiàn)4變量邏輯函數(shù)F（A，B，C，D），使用ABC作為控制變量，數(shù)據(jù)輸入端D0-D7可能的值有（）。
?如下圖所示時(shí)序電路，該電路是一個(gè)（）型電路，其功能是（）。
設(shè)計(jì)一個(gè)判斷輸入8421碼表示的十進(jìn)制數(shù)是否大于5的組合邏輯電路，至少需要（）個(gè)邏輯門(mén)。
邏輯函數(shù)F（A，B，C，D）=∑m（2，7，8，12，13，14，15）的卡諾圖，下面畫(huà)法正確的是（）。
?已知某異步時(shí)序電路的流程表如下表所示，其中x1和x2為電路輸入端。分析流程表，電路中有（）條反饋回路，當(dāng)（）時(shí)會(huì)發(fā)生臨界競(jìng)爭(zhēng)。
反映TTL與非門(mén)輸入高電平時(shí)抗干擾能力的外部特性參數(shù)是（）。
用PROM設(shè)計(jì)一個(gè)2位二進(jìn)制平方器，實(shí)現(xiàn)該平方器需要的容量至少為（）。
下圖所示的PLD連接表示的輸出函數(shù)表達(dá)式F等于（）。
已知原始狀態(tài)圖如下圖所示，狀態(tài)化簡(jiǎn)后電路需要的觸發(fā)器應(yīng)為（）個(gè)。