CMOS傳輸門組成的電路如圖所示,當(dāng)C=0時(shí),U0=(),當(dāng)C=1時(shí),U0=()。
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A.6
B.8
C.10
D.不定
A.
B.
C.
D.
函數(shù)F=,當(dāng)變量取值為(),不會(huì)出現(xiàn)冒險(xiǎn)現(xiàn)象。
A.B=C=1
B.B=C=0
C.A=1,C=0
D.A=B=0
最新試題
實(shí)現(xiàn)模(215)10的加法計(jì)數(shù)需要()片74193。
設(shè)計(jì)一個(gè)判斷輸入8421碼表示的十進(jìn)制數(shù)是否大于5的組合邏輯電路,至少需要()個(gè)邏輯門。
假定描述一個(gè)同步時(shí)序電路的最簡(jiǎn)狀態(tài)表中有6個(gè)狀態(tài),則該電路中有()個(gè)觸發(fā)器,電路中存在()個(gè)多余狀態(tài)。?
為了實(shí)現(xiàn)計(jì)數(shù)功能,集成寄存器74194的控制端S0S1可以是()。
用5G555構(gòu)成的施密特觸發(fā)器具有()個(gè)穩(wěn)態(tài)。
?如下圖所示時(shí)序電路,該電路是一個(gè)()型電路,其功能是()。
反映TTL與非門輸入高電平時(shí)抗干擾能力的外部特性參數(shù)是()。
邏輯函數(shù)F(A,B,C,D)=∑m(2,7,8,12,13,14,15)的卡諾圖,下面畫法正確的是()。
?已知描述某同步時(shí)序電路的狀態(tài)圖如下圖所示,假定輸入序列為x=01011011,初始狀態(tài)為A,則電路的狀態(tài)序列為(),輸出響應(yīng)序列為()。
?具有3個(gè)選擇控制端的數(shù)據(jù)選擇器能對(duì)()個(gè)輸入數(shù)據(jù)進(jìn)行選擇,對(duì)應(yīng)選擇輸入端的任何一種取值,可選中()個(gè)輸入數(shù)據(jù)輸出。?