問答題
分析題圖所示由集成4位二進(jìn)制計(jì)數(shù)器CT74161和集成2線-4線譯碼器構(gòu)成的電路；設(shè)時(shí)鐘脈沖CP的頻率fCP=90kHZ，說明當(dāng)譯碼器的地址輸入AB分別為00、01、10、11時(shí)，CT7461的輸出CO的頻率f各是多少？
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設(shè)計(jì)一個(gè)判斷輸入8421碼表示的十進(jìn)制數(shù)是否大于5的組合邏輯電路，至少需要（）個(gè)邏輯門。
題型：?jiǎn)雾?xiàng)選擇題
現(xiàn)場(chǎng)可編程門陣列FPGA的設(shè)計(jì)流程中，下列屬于規(guī)劃設(shè)計(jì)階段的工作有（）。
題型：多項(xiàng)選擇題
下圖所示CMOS電路實(shí)現(xiàn)的邏輯是（）。
題型：?jiǎn)雾?xiàng)選擇題
一個(gè)n位的D/A換器的分辨率為（）。
題型：?jiǎn)雾?xiàng)選擇題
?下面關(guān)于用5G555構(gòu)成的施密特觸發(fā)器描述錯(cuò)誤的是（）。
題型：?jiǎn)雾?xiàng)選擇題
輸出端與輸出端可以直接連接，實(shí)現(xiàn)“線與”的門電路有（）。
題型：?jiǎn)雾?xiàng)選擇題
下圖所示電路的功能是（）。
題型：?jiǎn)雾?xiàng)選擇題
反映TTL與非門輸入高電平時(shí)抗干擾能力的外部特性參數(shù)是（）。
題型：?jiǎn)雾?xiàng)選擇題
假定描述一個(gè)同步時(shí)序電路的最簡(jiǎn)狀態(tài)表中有6個(gè)狀態(tài)，則該電路中有（）個(gè)觸發(fā)器，電路中存在（）個(gè)多余狀態(tài)。?
題型：?jiǎn)雾?xiàng)選擇題
設(shè)計(jì)一個(gè)Moore型同步可重疊的“1101”序列檢測(cè)器，至少需要（）個(gè)觸發(fā)器。
題型：?jiǎn)雾?xiàng)選擇題