圖示ROM陣列邏輯圖,當?shù)刂窞锳1A0=10時,該字單元的內容為()
A.1110
B.0111
C.1010
D.0100
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函數(shù)F=+AB轉換成或非-或非式為()
A.A
B.B
C.C
D.D
A.F=AB
B.F=A+B
C.A+BC
D.F=B+C
邏輯函 ,當變量的取值為()時,將出現(xiàn)競爭冒險現(xiàn)象。
A.B=C=1
B.B=C=0
C.A=1,C=0
D.A=0,B=0
一個3:8線的地址譯碼器(74LS138),其控制信G1、的組合為()時才對輸入進行譯碼。
A.110
B.101
C.111
D.100
A.2
B.3
C.4
D.5
最新試題
約束項在函數(shù)化簡時可以當作1,是因為在實際電路中,這種輸入組合根本不可能會讓其發(fā)生。
TTL門電路具有負載能力強、抗干擾能力強和轉換速度高等特點。
要使TTL與非門變成反相器,多余的輸入端不能采用的方法為()。
要使JK觸發(fā)器在時鐘脈沖作用下,實現(xiàn)輸出,則輸入信號應為()。
已知有二輸入邏輯門,只有當輸X和Y都為1時,輸出F才為1,則X,Y與F的邏輯關系為()。
?BCD碼譯碼器如果不允許輸入大于9的數(shù)值的時候,當輸入10時,輸出為()。
輸出端不能直接線與的門電路有()。
若集成塊內部為驅動單元提供的驅動能力為1X,最小反相器(1X)延遲時間為2,對于下圖所示的輸出緩沖設計(圖中反相器上面標注了相應的驅動能力),該輸出單元的延遲時間(從a到y(tǒng))最接近于()。
關于集成塊的輸出單元,下列說法中正確的是()。
使用74HC138實現(xiàn)邏輯函數(shù)正確的是()。