單項(xiàng)選擇題其邏輯功能相當(dāng)于雙向模擬開關(guān)的邏輯門是()。
A.傳輸門
B.或非門
C.三態(tài)門
D.OC門
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1.單項(xiàng)選擇題?相同位數(shù)的下列進(jìn)制,()表示的數(shù)值范圍最大。
A.二進(jìn)制
B.八進(jìn)制
C.十進(jìn)制
D.十六進(jìn)制
2.單項(xiàng)選擇題?以下關(guān)于格雷碼的特點(diǎn)描述正確的是()
A.相鄰2個(gè)代碼之間只有1位不同
B.相鄰2個(gè)代碼之間有2位不同
C.相鄰2個(gè)代碼之間有3位不同
D.相鄰2個(gè)代碼之間有4位不同
3.單項(xiàng)選擇題?十進(jìn)制數(shù)28.43的余3BCD碼是()。
A.00111000.01000011
B.01011011.01110110
C.01101100.10000111
D.01111101.10011000
4.單項(xiàng)選擇題十進(jìn)制數(shù)127.25對(duì)應(yīng)二進(jìn)制數(shù)為()。
A.1111111.01
B.1000000010
C.111110.01
D.1100011.11
5.單項(xiàng)選擇題?能夠表示任意一個(gè)三位十進(jìn)制數(shù)至少需要()位二進(jìn)制數(shù)。
A.8
B.9
C.10
D.11
最新試題
對(duì)于一個(gè)輸入為XYZ的脈沖異步時(shí)序邏輯電路,下面的輸入脈沖組合中,()是允許的。
題型:多項(xiàng)選擇題
現(xiàn)場(chǎng)可編程門陣列FPGA的基本結(jié)構(gòu)由()組成。
題型:多項(xiàng)選擇題
在正常工作時(shí),3-8線譯碼器74138的使能端的值為()。
題型:?jiǎn)雾?xiàng)選擇題
反映TTL與非門輸入高電平時(shí)抗干擾能力的外部特性參數(shù)是()。
題型:?jiǎn)雾?xiàng)選擇題
下圖所示組合邏輯電路,其功能是()。
題型:?jiǎn)雾?xiàng)選擇題
?如下圖所示時(shí)序電路,該電路是一個(gè)()型電路,其功能是()。
題型:?jiǎn)雾?xiàng)選擇題
下面圖示的電路可以實(shí)現(xiàn)()功能。
題型:?jiǎn)雾?xiàng)選擇題
現(xiàn)場(chǎng)可編程門陣列FPGA的設(shè)計(jì)流程中,下列屬于規(guī)劃設(shè)計(jì)階段的工作有()。
題型:多項(xiàng)選擇題
?已知某異步時(shí)序電路的流程表如下表所示,其中x1和x2為電路輸入端。分析流程表,電路中有()條反饋回路,當(dāng)()時(shí)會(huì)發(fā)生臨界競(jìng)爭(zhēng)。
題型:?jiǎn)雾?xiàng)選擇題
?已知脈沖異步時(shí)序邏輯電路如下圖所示,其功能是()。
題型:?jiǎn)雾?xiàng)選擇題