問(wèn)答題

分析下圖組合邏輯電路的功能,寫(xiě)出輸出表達(dá)式


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已知函數(shù)F(A,B,C,D)=(AB’)’+(C’D+B’C)’,則其最簡(jiǎn)表達(dá)式為()。

題型:?jiǎn)雾?xiàng)選擇題

若n個(gè)變量的同或運(yùn)算和異或運(yùn)算結(jié)果相同,則n為奇數(shù)()

題型:判斷題

?如圖所示電路論述正確的是()。

題型:多項(xiàng)選擇題

要使TTL與非門(mén)變成反相器,多余的輸入端不能采用的方法為()。

題型:?jiǎn)雾?xiàng)選擇題

要使JK觸發(fā)器在時(shí)鐘脈沖作用下,實(shí)現(xiàn)輸出,則輸入信號(hào)應(yīng)為()。

題型:?jiǎn)雾?xiàng)選擇題

如圖電路實(shí)現(xiàn)的邏輯函數(shù)是()。

題型:多項(xiàng)選擇題

?十進(jìn)制數(shù)178.5對(duì)應(yīng)的余3碼是()。

題型:?jiǎn)雾?xiàng)選擇題

?若集成塊內(nèi)部為驅(qū)動(dòng)單元提供的驅(qū)動(dòng)能力為1X,對(duì)于下圖所示的輸出緩沖設(shè)計(jì)(圖中反相器上面標(biāo)注了相應(yīng)的驅(qū)動(dòng)能力),該輸出單元的延遲時(shí)間(從a到y(tǒng))相當(dāng)于()個(gè)內(nèi)部標(biāo)準(zhǔn)門(mén)級(jí)聯(lián)的延遲時(shí)間。

題型:?jiǎn)雾?xiàng)選擇題

使用74HC138實(shí)現(xiàn)邏輯函數(shù)正確的是()。

題型:?jiǎn)雾?xiàng)選擇題

已知有二輸入邏輯門(mén),只有當(dāng)輸X和Y都為1時(shí),輸出F才為1,則X,Y與F的邏輯關(guān)系為()。

題型:?jiǎn)雾?xiàng)選擇題