某觸發(fā)器的狀態(tài)是在CP的下降沿發(fā)生變化,它的電路符號應(yīng)為()
A.A
B.B
C.C
D.D
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兩個與非門構(gòu)成的基本RS鎖存器,器的輸出Q會()。
A.變?yōu)?
B.保持1不變
C.保持0不變
D.無法確定
A.數(shù)字信號
B.模擬信號
C.數(shù)模混合信號
D.數(shù)字和模擬信號
A.接邏輯“1”
B.接邏輯“0”
C.接2.4V電壓
D.邏輯不定
A.固定接0
B.固定接1
C.同時使能
D.分時使能
A.1;1
B.1;0
C.0;0
D.不確定
最新試題
?利用開關(guān)代數(shù)的公理或定理,判斷與(x+y’)’等價的邏輯關(guān)系為()。
要使JK觸發(fā)器在時鐘脈沖作用下,實現(xiàn)輸出,則輸入信號應(yīng)為()。
?十進(jìn)制數(shù)22.37對應(yīng)的二進(jìn)制數(shù)是()。
使用74HC138實現(xiàn)邏輯函數(shù)正確的是()。
二進(jìn)制加法運(yùn)算包含的輸入、輸出變量有()。
?BCD碼譯碼器如果不允許輸入大于9的數(shù)值的時候,當(dāng)輸入10時,輸出為()。
?十進(jìn)制數(shù)178.5對應(yīng)的余3碼是()。
若集成塊內(nèi)部為驅(qū)動單元提供的驅(qū)動能力為1X,最小反相器(1X)延遲時間為2,對于下圖所示的輸出緩沖設(shè)計(圖中反相器上面標(biāo)注了相應(yīng)的驅(qū)動能力),該輸出單元的延遲時間(從a到y(tǒng))最接近于()。
關(guān)于集成塊的輸出單元,下列說法中正確的是()。
如圖,此電路的輸入端I0_L是低電平有效,輸出A2A1A0是高電平有效,AVALID有效表示的是()。