單項(xiàng)選擇題可編程陣列邏輯簡(jiǎn)稱(chēng)為什么？（）
A.GAL
B.PAL
C.PLA
D.PLD
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1.單項(xiàng)選擇題四路數(shù)據(jù)選擇器的輸出端有：（）。
A.1個(gè)
B.2個(gè)
C.3個(gè)
D.4個(gè)
2.單項(xiàng)選擇題下列哪種類(lèi)型的集成電路的集成度更高？（）
A.CMOS
B.TTL
C.ECL
D.都一樣
3.單項(xiàng)選擇題構(gòu)造一個(gè)100脈沖序列檢測(cè)器需要多少個(gè)觸發(fā)器？（）
A.1個(gè)
B.2個(gè)
C.3個(gè)
D.4個(gè)
4.單項(xiàng)選擇題當(dāng)JK觸發(fā)器的次態(tài)Qn+1=，則輸入J，K為（）。
A.0，0
B.0，1
C.1，0
D.1，1
5.單項(xiàng)選擇題當(dāng)D觸發(fā)器的次態(tài)等于現(xiàn)態(tài)時(shí)，其輸入端D=（）。
A.0
B.1
C.Q
最新試題
用PROM設(shè)計(jì)一個(gè)2位二進(jìn)制平方器，實(shí)現(xiàn)該平方器需要的容量至少為（）。
題型：?jiǎn)雾?xiàng)選擇題
為了實(shí)現(xiàn)計(jì)數(shù)功能，集成寄存器74194的控制端S0S1可以是（）。
題型：多項(xiàng)選擇題
一個(gè)n位的D/A換器的分辨率為（）。
題型：?jiǎn)雾?xiàng)選擇題
電平異步時(shí)序邏輯電路工作的基本條件有（）。
題型：多項(xiàng)選擇題
邏輯函數(shù)F（A，B，C，D）=∑m（2，7，8，12，13，14，15）的卡諾圖，下面畫(huà)法正確的是（）。
題型：?jiǎn)雾?xiàng)選擇題
?已知描述某同步時(shí)序電路的狀態(tài)圖如下圖所示，假定輸入序列為x=01011011，初始狀態(tài)為A，則電路的狀態(tài)序列為（），輸出響應(yīng)序列為（）。
題型：?jiǎn)雾?xiàng)選擇題
現(xiàn)場(chǎng)可編程門(mén)陣列FPGA的基本結(jié)構(gòu)由（）組成。
題型：多項(xiàng)選擇題
下圖所示的PLD連接表示的輸出函數(shù)表達(dá)式F等于（）。
題型：?jiǎn)雾?xiàng)選擇題
實(shí)現(xiàn)模（215）10的加法計(jì)數(shù)需要（）片74193。
題型：?jiǎn)雾?xiàng)選擇題
設(shè)計(jì)一個(gè)Moore型同步可重疊的“1101”序列檢測(cè)器，至少需要（）個(gè)觸發(fā)器。
題型：?jiǎn)雾?xiàng)選擇題