下面圖示電路中，當(dāng)M=1時(shí)，實(shí)現(xiàn)的是模（）計(jì)數(shù)功能。
A.7
B.8
C.9
D.10
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?如下圖所示電路，假設(shè)初始狀態(tài)為0000，DR和DL端串行輸入序列11011001（從左至右順序輸入），在4個(gè)時(shí)鐘周期后，寄存器狀態(tài)輸入QDQCQBQA為（）。
A.1011
B.1101
C.1001
D.1000
A.有16個(gè)輸入端，1個(gè)輸出端，4個(gè)控制端
B.有16個(gè)輸入端，1個(gè)輸出端，3個(gè)控制端
C.有1個(gè)輸入端，16個(gè)輸出端，4個(gè)控制端
D.有1個(gè)輸入端，16個(gè)輸出端，3個(gè)控制端
?某電平異步時(shí)序邏輯電路的流程表如下表所示，電路中存在非臨界競爭的位置有（）。
A.穩(wěn)態(tài)（00，11）輸入由00變?yōu)?1
B.穩(wěn)態(tài)（11，01）輸入由11變?yōu)?0
C.穩(wěn)態(tài)（11，11）輸入由11變?yōu)?1
D.穩(wěn)態(tài)（10，10）輸入由10變?yōu)?1
?下圖所示電路是一個(gè)（）。
?A.組合邏輯電路
B.同步時(shí)序邏輯電路
C.脈沖異步時(shí)序邏輯電路
D.電平異步時(shí)序邏輯電路
在下圖所示電路中，假定初始狀態(tài)y2y1=00，請問在輸入端x接收3個(gè)脈沖后，電路狀態(tài)y2y1是（）。
A.00
B.01
C.10
D.11
最新試題
?如下圖所示時(shí)序電路，該電路是一個(gè)（）型電路，其功能是（）。
?具有3個(gè)選擇控制端的數(shù)據(jù)選擇器能對（）個(gè)輸入數(shù)據(jù)進(jìn)行選擇，對應(yīng)選擇輸入端的任何一種取值，可選中（）個(gè)輸入數(shù)據(jù)輸出。?
假定某個(gè)電路如圖示，指示燈F和開關(guān)A、B、C的邏輯關(guān)系表達(dá)式為（）。
已知原始狀態(tài)圖如下圖所示，狀態(tài)化簡后電路需要的觸發(fā)器應(yīng)為（）個(gè)。
現(xiàn)場可編程門陣列FPGA的基本結(jié)構(gòu)由（）組成。
下圖所示組合邏輯電路，輸入ABCD為8421碼，則電路的輸出WXYZ是（）。
下圖所示的PLD連接表示的輸出函數(shù)表達(dá)式F等于（）。
電平異步時(shí)序邏輯電路工作的基本條件有（）。
使用8路選擇器實(shí)現(xiàn)4變量邏輯函數(shù)F（A，B，C，D），使用ABC作為控制變量，數(shù)據(jù)輸入端D0-D7可能的值有（）。
下面圖示的電路可以實(shí)現(xiàn)（）功能。